Design subhierarchy
dashboard | hierarchy | modlist | groups | tests | asserts

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NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
gen_alert_tx[0].u_prim_alert_sender 100.00 100.00
spi_device_csr_assert 1.64 1.64
tlul_assert_device 95.24 100.00 85.71 100.00
u_clk_csb_buf 100.00 100.00
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gen_generic.u_impl_generic 100.00 100.00 100.00
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prim_flop_2sync 100.00 100.00 100.00
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gen_generic.u_impl_generic 100.00 100.00 100.00
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u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
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u_tx_fifo 99.17 100.00 96.67 100.00 100.00
sync_rptr 100.00 100.00 100.00
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gen_generic.u_impl_generic 100.00 100.00 100.00
sync_wptr 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
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u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_txf_ctrl 93.63 95.12 89.66 100.00 89.74
u_intr_cmdfifo_not_empty 93.75 100.00 75.00 100.00 100.00
u_intr_payload_not_empty 93.75 100.00 75.00 100.00 100.00
u_intr_payload_overflow 93.75 100.00 75.00 100.00 100.00
u_intr_readbuf_flip 91.67 100.00 66.67 100.00 100.00
u_intr_readbuf_watermark 91.67 100.00 66.67 100.00 100.00
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u_intr_rxf 91.67 100.00 66.67 100.00 100.00
u_intr_rxlvl 93.75 100.00 75.00 100.00 100.00
u_intr_rxoverflow 91.67 100.00 66.67 100.00 100.00
u_intr_tpm_cmdaddr_notempty 86.94 90.00 77.78 80.00 100.00
u_intr_txlvl 93.75 100.00 75.00 100.00 100.00
u_intr_txunderflow 93.75 100.00 75.00 100.00 100.00
u_intr_upload_edge 100.00 100.00 100.00
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u_mem 100.00 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00 100.00
u_p2s 90.20 100.00 84.62 76.19 100.00
u_passthrough 90.46 94.33 90.09 75.00 92.86 100.00
u_pt_isck_cg 100.00 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00 100.00
u_pt_sck_cg 100.00 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00 100.00
u_readcmd 92.82 97.16 91.62 87.50 87.82 100.00
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u_fifo 96.88 100.00 87.50 100.00 100.00
gen_normal_fifo.u_fifo_cnt 100.00 100.00 100.00
u_sram_fifo 88.33 95.00 75.00 83.33 100.00
gen_normal_fifo.u_fifo_cnt 81.94 88.89 75.00
u_reg 99.66 99.49 99.47 100.00 99.32 100.00
subtree...
u_rx_rst_scan_mux 64.81 100.00 44.44 50.00
gen_generic.u_impl_generic 64.81 100.00 44.44 50.00
u_rxf_overflow 75.00 100.00 100.00 100.00 0.00
prim_flop_2sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_s2p 89.85 100.00 85.71 73.68 100.00
u_scanmode_sync 100.00 100.00
u_sck_csb_edge 94.44 100.00 83.33 100.00
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u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sck_tog_edge 100.00 100.00 100.00 100.00
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u_sync_1 100.00 100.00 100.00
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u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_spi_tpm 96.29 99.52 93.53 91.67 96.71 100.00
u_cmdaddr_buffer 98.08 100.00 92.31 100.00 100.00
sync_rptr 100.00 100.00 100.00
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gen_generic.u_impl_generic 100.00 100.00 100.00
sync_wptr 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
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u_sync_2 100.00 100.00 100.00
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u_hw_reg_slice 100.00 100.00 100.00
u_rdfifo 98.44 100.00 93.75 100.00 100.00
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u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
sync_wptr 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_wrfifo 98.44 100.00 93.75 100.00 100.00
sync_rptr 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
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gen_generic.u_impl_generic 100.00 100.00 100.00
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u_spid_addr_4b 98.41 100.00 95.24 100.00
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gen_generic.u_impl_generic 100.00 100.00 100.00
u_sys2spi_sync 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_spid_status 96.19 100.00 86.84 100.00 94.12 100.00
u_stage_to_commit 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sw_status_update_sync 93.44 100.00 80.00 93.75 100.00
sync_rptr 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
sync_wptr 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
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gen_generic.u_impl_generic 83.33 100.00 50.00 100.00
u_sram_clk_scan 64.81 100.00 44.44 50.00
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u_sram_clk_sel 100.00 100.00 100.00 100.00
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u_sram_rst_scanmux 64.81 100.00 44.44 50.00
gen_generic.u_impl_generic 64.81 100.00 44.44 50.00
u_sram_rst_sel 96.30 100.00 88.89 100.00
gen_generic.u_impl_generic 96.30 100.00 88.89 100.00
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u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_txe 100.00 100.00 100.00
u_sync_1 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_sys_sram_arbiter 87.03 100.00 70.73 96.43 80.95
gen_arb_ppc.u_reqarb 90.97 100.00 88.89 100.00 75.00
u_req_fifo 89.96 100.00 65.38 94.44 100.00
gen_normal_fifo.u_fifo_cnt 100.00 100.00 100.00
u_sys_tpm_csb_sync 100.00 100.00 100.00
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gen_generic.u_impl_generic 100.00 100.00 100.00
u_tlul2sram 87.50 88.70 76.07 85.23 100.00
u_err 91.88 100.00 80.00 87.50 100.00
u_reqfifo 87.85 95.00 73.08 83.33 100.00
gen_normal_fifo.u_fifo_cnt 81.94 88.89 75.00
u_rsp_gen 91.67 83.33 100.00
u_rspfifo 84.93 95.00 64.71 80.00 100.00
gen_normal_fifo.u_fifo_cnt 81.94 88.89 75.00
u_sram_byte 100.00 100.00
u_sramreqfifo 86.89 95.00 69.23 83.33 100.00
gen_normal_fifo.u_fifo_cnt 81.94 88.89 75.00
u_tlul_data_integ_enc_data 0.00 0.00
u_data_gen 0.00 0.00
u_tlul_data_integ_enc_instr 0.00 0.00
u_data_gen 0.00 0.00
u_tpm_csb_buf 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00
u_tpm_csb_rst_scan_mux 64.81 100.00 44.44 50.00
gen_generic.u_impl_generic 64.81 100.00 44.44 50.00
u_tpm_csb_rst_sync 70.83 88.89 44.44 100.00 50.00
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gen_generic.u_impl_generic 64.81 100.00 44.44 50.00
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0% 10% 20% 30% 40% 50% 60% 70% 80% 90% 100%