Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_ret_aon__regs_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	185400	1			T4	190		T5	92		T6	2
values[2]	4800	1			T4	2		T5	2		T6	2
values[3]	400	1			T6	2		T58	1		T70	1
values[4]	500	1			T6	4		T70	1		T74	4
values[5]	500	1			T6	4		T70	1		T74	4
values[6]	400	1			T6	3		T70	1		T74	3
values[7]	200	1			T6	1		T70	1		T74	1
values[8]	800	1			T6	7		T70	1		T74	7
values[9]	300	1			T6	2		T70	1		T74	2
values[10]	200	1			T6	1		T70	1		T74	1
values[11]	500	1			T6	4		T70	1		T74	4
values[12]	600	1			T6	5		T70	1		T74	5
values[13]	200	1			T6	1		T70	1		T74	1
values[14]	300	1			T6	2		T70	1		T74	2
values[15]	200	1			T6	1		T70	1		T74	1
values[16]	400	1			T6	3		T70	1		T74	3
values[17]	200	1			T6	1		T70	1		T74	1
values[18]	300	1			T6	2		T70	1		T74	2
values[19]	800	1			T6	7		T70	1		T74	7
values[20]	700	1			T6	6		T70	1		T74	6
values[21]	1400	1			T6	13		T70	1		T74	13
values[22]	900	1			T6	8		T70	1		T74	8
values[23]	1000	1			T6	9		T70	1		T74	9
values[24]	800	1			T6	7		T70	1		T74	7
values[25]	700	1			T6	6		T70	1		T74	6
values[26]	600	1			T6	5		T70	1		T74	5
values[27]	400	1			T6	3		T70	1		T74	3
values[28]	400	1			T6	3		T70	1		T74	3
values[29]	300	1			T6	2		T70	1		T74	2
values[30]	800	1			T6	7		T70	1		T74	7
values[31]	600	1			T6	5		T70	1		T74	5
values[32]	200	1			T6	1		T70	1		T74	1
values[33]	200	1			T6	1		T70	1		T74	1
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values[35]	200	1			T6	1		T70	1		T74	1
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values[125]	1400	1			T6	13		T70	1		T74	13
values[126]	1200	1			T6	11		T70	1		T74	11
values[127]	5500	1			T6	27		T70	28		T74	27
values[128]	34100	1			T6	13		T70	328		T74	13