Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.alert_handler_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
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Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	156686	1			T83	7		T84	122		T85	14
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values[110]	83	1			T87	1		T898	2		T639	6
values[111]	101	1			T87	3		T898	2		T639	15
values[112]	104	1			T87	2		T898	2		T639	3
values[113]	96	1			T87	2		T898	2		T639	5
values[114]	110	1			T87	3		T898	2		T639	2
values[115]	95	1			T87	2		T898	2		T639	5
values[116]	88	1			T87	1		T898	2		T639	6
values[117]	88	1			T87	2		T898	2		T639	8
values[118]	82	1			T87	1		T898	2		T639	6
values[119]	103	1			T87	2		T898	3		T639	6
values[120]	112	1			T87	1		T898	2		T639	5
values[121]	102	1			T87	2		T898	2		T639	5
values[122]	109	1			T87	1		T898	2		T639	3
values[123]	126	1			T87	4		T898	4		T639	4
values[124]	185	1			T87	1		T898	3		T639	11
values[125]	403	1			T87	1		T898	3		T639	31
values[126]	741	1			T87	9		T898	20		T639	23
values[127]	2252	1			T87	95		T898	301		T639	9
values[128]	3905	1			T87	197		T898	488		T899	200

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	134610	1			T83	3		T84	130		T85	25
values[2]	9190	1			T84	2		T136	1		T261	46
values[3]	3511	1			T261	13		T540	38		T505	7
values[4]	2162	1			T261	9		T540	27		T505	9
values[5]	1349	1			T261	3		T540	9		T505	3
values[6]	936	1			T261	8		T540	2		T505	10
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values[8]	480	1			T261	13		T505	5		T451	4
values[9]	385	1			T261	3		T505	14		T900	3
values[10]	387	1			T261	17		T505	7		T900	2
values[11]	364	1			T261	5		T505	3		T900	5
values[12]	314	1			T261	8		T505	8		T900	2
values[13]	352	1			T261	11		T505	8		T900	1
values[14]	362	1			T261	7		T505	8		T900	4
values[15]	304	1			T261	3		T505	4		T900	3
values[16]	293	1			T261	9		T505	4		T900	1
values[17]	304	1			T261	11		T505	15		T900	3
values[18]	290	1			T261	2		T505	10		T900	1
values[19]	371	1			T261	9		T505	4		T900	4
values[20]	294	1			T261	7		T505	7		T900	2
values[21]	305	1			T261	11		T505	4		T900	1
values[22]	309	1			T261	2		T505	9		T900	1
values[23]	327	1			T261	6		T505	14		T900	3
values[24]	340	1			T261	7		T505	8		T900	1
values[25]	368	1			T261	3		T505	5		T900	3
values[26]	340	1			T261	14		T505	9		T900	3
values[27]	294	1			T261	6		T505	13		T900	1
values[28]	286	1			T261	10		T505	4		T900	1
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values[33]	256	1			T261	3		T505	6		T900	1
values[34]	315	1			T261	12		T505	10		T900	2
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values[72]	121	1			T900	2		T448	14		T472	1
values[73]	96	1			T900	3		T448	3		T472	2
values[74]	102	1			T900	11		T448	6		T472	3
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values[125]	117	1			T671	4		T463	11		T511	2
values[126]	172	1			T671	13		T463	27		T511	4
values[127]	995	1			T671	20		T463	37		T511	7
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