Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.flash_ctrl__prim_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	155856	1			T83	9		T84	122		T85	14
values[2]	4618	1			T85	2		T87	1		T136	1
values[3]	2398	1			T87	1		T543	1		T553	1
values[4]	1722	1			T87	1		T451	46		T590	11
values[5]	1389	1			T87	1		T451	37		T590	4
values[6]	1145	1			T87	1		T451	31		T590	2
values[7]	893	1			T87	1		T451	29		T590	1
values[8]	827	1			T87	1		T451	26		T914	1
values[9]	804	1			T87	1		T451	25		T914	1
values[10]	627	1			T87	1		T451	23		T914	1
values[11]	569	1			T87	1		T451	24		T914	1
values[12]	481	1			T87	1		T451	27		T914	1
values[13]	457	1			T87	1		T451	21		T914	1
values[14]	423	1			T87	1		T451	9		T914	1
values[15]	295	1			T87	1		T451	8		T914	1
values[16]	336	1			T87	1		T451	6		T914	1
values[17]	308	1			T87	1		T451	13		T914	1
values[18]	383	1			T87	1		T451	31		T914	1
values[19]	349	1			T87	1		T451	18		T914	1
values[20]	299	1			T87	1		T451	22		T914	1
values[21]	327	1			T87	1		T451	29		T914	1
values[22]	358	1			T87	1		T451	50		T914	1
values[23]	384	1			T87	1		T451	77		T914	1
values[24]	420	1			T87	1		T451	89		T914	1
values[25]	429	1			T87	1		T451	94		T914	1
values[26]	429	1			T87	1		T451	70		T914	1
values[27]	302	1			T87	1		T451	27		T914	1
values[28]	214	1			T87	1		T451	42		T914	1
values[29]	137	1			T87	1		T451	19		T914	1
values[30]	125	1			T87	1		T451	7		T914	1
values[31]	125	1			T87	1		T451	2		T914	1
values[32]	141	1			T87	1		T914	1		T898	1
values[33]	222	1			T87	1		T914	1		T898	2
values[34]	210	1			T87	1		T914	1		T898	1
values[35]	140	1			T87	1		T914	1		T898	1
values[36]	112	1			T87	1		T914	1		T898	1
values[37]	123	1			T87	1		T914	1		T898	1
values[38]	99	1			T87	1		T914	1		T898	1
values[39]	108	1			T87	1		T914	1		T898	1
values[40]	82	1			T87	1		T914	1		T898	1
values[41]	66	1			T87	1		T914	1		T898	1
values[42]	81	1			T87	1		T914	1		T898	1
values[43]	68	1			T87	1		T914	1		T898	1
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values[47]	65	1			T87	1		T914	1		T898	1
values[48]	56	1			T87	1		T914	1		T898	1
values[49]	54	1			T87	1		T914	1		T898	1
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values[51]	64	1			T87	1		T914	1		T898	1
values[52]	69	1			T87	1		T914	1		T898	1
values[53]	65	1			T87	1		T914	1		T898	1
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values[55]	37	1			T87	1		T914	1		T898	1
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values[60]	46	1			T87	1		T914	1		T898	1
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values[62]	46	1			T87	1		T914	1		T898	1
values[63]	39	1			T87	1		T914	1		T898	1
values[64]	47	1			T87	1		T914	1		T898	1
values[65]	46	1			T87	1		T914	1		T898	1
values[66]	47	1			T87	1		T914	1		T898	1
values[67]	54	1			T87	1		T914	1		T898	1
values[68]	55	1			T87	1		T914	1		T898	1
values[69]	45	1			T87	1		T914	1		T898	1
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values[71]	45	1			T87	1		T914	1		T898	1
values[72]	46	1			T87	1		T914	1		T898	1
values[73]	49	1			T87	1		T914	1		T898	1
values[74]	44	1			T87	2		T914	1		T898	1
values[75]	44	1			T87	1		T914	1		T898	1
values[76]	47	1			T87	1		T914	1		T898	1
values[77]	40	1			T87	1		T914	1		T898	1
values[78]	49	1			T87	1		T914	1		T898	1
values[79]	58	1			T87	1		T914	1		T898	1
values[80]	46	1			T87	1		T914	1		T898	1
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values[100]	87	1			T87	1		T914	3		T898	6
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values[117]	60	1			T87	2		T914	1		T898	2
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values[122]	100	1			T87	2		T914	2		T898	1
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values[124]	230	1			T87	2		T914	4		T898	3
values[125]	340	1			T87	1		T914	1		T898	2
values[126]	626	1			T87	10		T914	11		T898	11
values[127]	2165	1			T87	96		T914	96		T898	94
values[128]	3591	1			T87	204		T914	201		T898	199