Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_main__ram_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1347134	1			T75	1960		T76	307		T77	4188
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values[3]	10795	1			T245	9		T456	1		T428	2
values[4]	3027	1			T245	1		T438	6		T539	6
values[5]	1283	1			T438	1		T539	10		T599	108
values[6]	738	1			T539	3		T599	96		T841	4
values[7]	548	1			T539	1		T599	72		T841	2
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values[9]	454	1			T539	1		T599	45		T841	2
values[10]	392	1			T539	3		T599	26		T841	3
values[11]	368	1			T539	2		T599	37		T841	4
values[12]	318	1			T539	2		T599	40		T841	1
values[13]	337	1			T539	3		T599	43		T841	2
values[14]	339	1			T539	7		T599	39		T841	1
values[15]	323	1			T539	2		T599	25		T841	2
values[16]	338	1			T539	1		T599	14		T841	2
values[17]	317	1			T539	4		T599	15		T841	2
values[18]	329	1			T539	7		T599	24		T841	2
values[19]	255	1			T539	4		T599	31		T841	4
values[20]	245	1			T539	1		T599	35		T841	5
values[21]	285	1			T539	3		T599	46		T841	8
values[22]	281	1			T539	4		T599	50		T841	3
values[23]	276	1			T539	10		T599	48		T841	4
values[24]	233	1			T539	1		T599	30		T841	1
values[25]	268	1			T539	4		T599	28		T841	5
values[26]	244	1			T539	3		T599	21		T841	6
values[27]	220	1			T539	2		T599	11		T841	4
values[28]	204	1			T539	1		T599	13		T841	3
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values[55]	253	1			T539	2		T599	45		T841	4
values[56]	185	1			T539	2		T599	25		T841	1
values[57]	178	1			T539	1		T599	15		T841	1
values[58]	159	1			T539	1		T599	17		T841	3
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values[191]	1835	1			T853	35		T528	29		T462	66
values[192]	10437	1			T853	442		T528	419		T462	41