Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_main__ram_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1313458	1			T102	32		T103	22		T104	156
values[2]	80865	1			T102	7		T104	25		T187	5
values[3]	11126	1			T104	2		T187	2		T459	21
values[4]	3168	1			T187	1		T459	5		T549	1
values[5]	1422	1			T459	4		T549	1		T643	1
values[6]	924	1			T459	1		T589	2		T801	1
values[7]	747	1			T459	1		T589	3		T801	1
values[8]	736	1			T589	3		T801	1		T525	4
values[9]	703	1			T589	6		T801	5		T525	5
values[10]	631	1			T589	12		T801	11		T525	6
values[11]	566	1			T589	1		T801	5		T525	7
values[12]	495	1			T589	1		T801	2		T525	10
values[13]	498	1			T589	1		T801	3		T525	8
values[14]	444	1			T589	5		T801	3		T525	3
values[15]	455	1			T589	2		T801	1		T525	2
values[16]	490	1			T589	5		T801	3		T525	4
values[17]	397	1			T589	1		T801	4		T525	2
values[18]	373	1			T589	1		T801	7		T525	3
values[19]	376	1			T589	3		T801	3		T525	3
values[20]	359	1			T589	6		T801	5		T525	2
values[21]	383	1			T589	13		T801	3		T525	3
values[22]	376	1			T589	5		T801	2		T525	3
values[23]	383	1			T589	3		T801	3		T525	4
values[24]	415	1			T589	4		T801	5		T525	5
values[25]	399	1			T589	8		T801	3		T525	3
values[26]	362	1			T589	5		T801	3		T525	2
values[27]	343	1			T589	7		T801	3		T525	5
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values[30]	318	1			T801	2		T525	2		T468	2
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values[34]	317	1			T801	2		T525	4		T468	3
values[35]	306	1			T801	3		T525	2		T468	2
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values[186]	174	1			T525	14		T468	12		T469	8
values[187]	197	1			T525	14		T468	9		T469	3
values[188]	286	1			T525	21		T468	5		T469	6
values[189]	682	1			T525	58		T468	8		T469	18
values[190]	1854	1			T525	154		T468	7		T469	73
values[191]	3759	1			T525	242		T468	79		T469	148
values[192]	7469	1			T525	73		T468	810		T469	75