Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.usbdev_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	199607	1			T1	2		T2	140		T3	11
values[2]	9889	1			T1	2		T2	12		T3	1
values[3]	3091	1			T1	2		T2	5		T12	1
values[4]	1688	1			T1	2		T12	1		T76	57
values[5]	1221	1			T1	2		T12	1		T76	39
values[6]	860	1			T1	2		T12	1		T76	10
values[7]	642	1			T1	2		T12	1		T97	2
values[8]	466	1			T1	2		T12	1		T97	2
values[9]	448	1			T1	2		T12	1		T97	2
values[10]	369	1			T1	2		T12	1		T97	2
values[11]	421	1			T1	2		T12	1		T97	2
values[12]	490	1			T1	2		T12	1		T97	2
values[13]	482	1			T1	2		T12	1		T97	2
values[14]	413	1			T1	2		T12	1		T97	2
values[15]	335	1			T1	2		T12	1		T97	2
values[16]	283	1			T1	2		T12	1		T97	2
values[17]	253	1			T1	3		T12	1		T97	2
values[18]	289	1			T1	3		T12	1		T97	2
values[19]	411	1			T1	2		T12	1		T97	2
values[20]	299	1			T1	2		T12	1		T97	2
values[21]	255	1			T1	2		T12	1		T97	2
values[22]	288	1			T1	2		T12	1		T97	2
values[23]	208	1			T1	2		T12	1		T97	2
values[24]	249	1			T1	2		T12	1		T97	2
values[25]	244	1			T1	2		T12	1		T97	2
values[26]	177	1			T1	2		T12	1		T97	2
values[27]	215	1			T1	2		T12	1		T97	2
values[28]	173	1			T1	2		T12	1		T97	2
values[29]	176	1			T1	2		T12	1		T97	2
values[30]	156	1			T1	2		T12	1		T97	2
values[31]	158	1			T1	2		T12	1		T97	2
values[32]	167	1			T1	2		T12	1		T97	2
values[33]	141	1			T1	2		T12	1		T97	2
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values[35]	189	1			T1	2		T12	1		T97	2
values[36]	187	1			T1	2		T12	1		T97	2
values[37]	139	1			T1	2		T12	1		T97	2
values[38]	117	1			T1	2		T12	1		T97	2
values[39]	112	1			T1	2		T12	1		T97	2
values[40]	176	1			T1	2		T12	1		T97	2
values[41]	152	1			T1	2		T12	1		T97	2
values[42]	137	1			T1	2		T12	1		T97	2
values[43]	117	1			T1	2		T12	1		T97	2
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values[52]	88	1			T1	2		T12	1		T97	2
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values[65]	101	1			T1	2		T12	1		T97	2
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values[67]	89	1			T1	2		T12	2		T97	2
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values[74]	96	1			T1	2		T12	1		T97	2
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values[83]	60	1			T1	2		T12	1		T97	2
values[84]	55	1			T1	2		T12	1		T97	2
values[85]	43	1			T1	2		T12	1		T97	2
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values[122]	35	1			T1	3		T12	3		T97	3
values[123]	37	1			T1	5		T12	3		T97	3
values[124]	38	1			T1	3		T12	3		T97	4
values[125]	37	1			T1	5		T12	1		T97	4
values[126]	232	1			T1	10		T12	8		T97	7
values[127]	1833	1			T1	104		T12	110		T97	32
values[128]	5001	1			T1	598		T12	164		T97	620