Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.edn1_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	212099	1			T2	140		T3	9		T7	18
values[2]	8134	1			T2	15		T3	1		T8	14
values[3]	3030	1			T2	1		T8	1		T12	3
values[4]	2164	1			T12	3		T16	2		T97	1
values[5]	1686	1			T12	3		T97	1		T68	83
values[6]	1503	1			T12	3		T97	1		T68	70
values[7]	1164	1			T12	3		T97	2		T68	56
values[8]	871	1			T12	3		T97	1		T68	47
values[9]	788	1			T12	3		T97	1		T68	28
values[10]	673	1			T12	3		T97	1		T68	9
values[11]	677	1			T12	3		T97	1		T68	4
values[12]	713	1			T12	3		T97	1		T68	4
values[13]	601	1			T12	3		T97	1		T73	1
values[14]	491	1			T12	3		T97	1		T73	1
values[15]	410	1			T12	3		T97	1		T73	1
values[16]	382	1			T12	3		T97	1		T73	1
values[17]	311	1			T12	3		T97	1		T73	1
values[18]	339	1			T12	3		T97	1		T73	1
values[19]	364	1			T12	3		T97	1		T73	1
values[20]	333	1			T12	3		T97	1		T73	1
values[21]	283	1			T12	3		T97	1		T73	1
values[22]	337	1			T12	3		T97	1		T73	1
values[23]	429	1			T12	3		T97	1		T73	1
values[24]	473	1			T12	3		T97	1		T73	1
values[25]	377	1			T12	3		T97	1		T73	1
values[26]	311	1			T12	3		T97	1		T73	1
values[27]	289	1			T12	3		T97	1		T73	1
values[28]	250	1			T12	3		T97	1		T73	1
values[29]	253	1			T12	3		T97	1		T73	1
values[30]	176	1			T12	3		T97	1		T73	1
values[31]	149	1			T12	3		T97	1		T73	1
values[32]	164	1			T12	3		T97	1		T73	2
values[33]	151	1			T12	3		T97	1		T73	1
values[34]	117	1			T12	3		T97	1		T73	1
values[35]	114	1			T12	3		T97	1		T73	1
values[36]	84	1			T12	3		T97	1		T73	1
values[37]	78	1			T12	3		T97	1		T73	1
values[38]	75	1			T12	3		T97	1		T73	1
values[39]	79	1			T12	3		T97	1		T73	1
values[40]	85	1			T12	3		T97	1		T73	1
values[41]	74	1			T12	3		T97	1		T73	1
values[42]	70	1			T12	3		T97	1		T73	1
values[43]	84	1			T12	3		T97	1		T73	1
values[44]	107	1			T12	3		T97	1		T73	1
values[45]	89	1			T12	3		T97	1		T73	1
values[46]	93	1			T12	3		T97	1		T73	1
values[47]	74	1			T12	3		T97	1		T73	1
values[48]	103	1			T12	3		T97	1		T73	1
values[49]	80	1			T12	3		T97	1		T73	1
values[50]	79	1			T12	3		T97	1		T73	1
values[51]	82	1			T12	3		T97	1		T73	1
values[52]	97	1			T12	3		T97	1		T73	1
values[53]	86	1			T12	3		T97	1		T73	1
values[54]	76	1			T12	4		T97	1		T73	1
values[55]	65	1			T12	3		T97	1		T73	1
values[56]	84	1			T12	3		T97	1		T73	1
values[57]	82	1			T12	3		T97	1		T73	1
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values[59]	66	1			T12	3		T97	1		T73	1
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values[61]	64	1			T12	3		T97	1		T73	1
values[62]	63	1			T12	3		T97	1		T73	1
values[63]	64	1			T12	3		T97	1		T73	1
values[64]	78	1			T12	3		T97	1		T73	1
values[65]	70	1			T12	3		T97	1		T73	1
values[66]	80	1			T12	3		T97	1		T73	1
values[67]	68	1			T12	3		T97	1		T73	1
values[68]	70	1			T12	3		T97	1		T73	1
values[69]	61	1			T12	3		T97	1		T73	1
values[70]	69	1			T12	3		T97	1		T73	1
values[71]	70	1			T12	3		T97	1		T73	1
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values[101]	134	1			T12	5		T97	3		T73	1
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values[108]	113	1			T12	6		T97	8		T73	1
values[109]	135	1			T12	5		T97	6		T73	1
values[110]	119	1			T12	4		T97	2		T73	2
values[111]	121	1			T12	3		T97	2		T73	1
values[112]	123	1			T12	4		T97	2		T73	2
values[113]	143	1			T12	5		T97	3		T73	1
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values[115]	121	1			T12	3		T97	1		T73	2
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values[117]	125	1			T12	6		T97	1		T73	2
values[118]	122	1			T12	6		T97	2		T73	4
values[119]	108	1			T12	5		T97	3		T73	3
values[120]	103	1			T12	8		T97	1		T73	2
values[121]	108	1			T12	5		T97	1		T73	1
values[122]	102	1			T12	4		T97	2		T73	1
values[123]	113	1			T12	3		T97	1		T73	2
values[124]	244	1			T12	7		T97	3		T73	1
values[125]	396	1			T12	4		T97	2		T73	1
values[126]	767	1			T12	37		T97	12		T73	21
values[127]	3161	1			T12	314		T97	91		T73	152
values[128]	5725	1			T12	600		T97	233		T73	233