Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_main__ram_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1293181	1			T14	323		T15	34		T16	294
values[2]	77906	1			T15	3		T16	14		T17	5
values[3]	10585	1			T15	3		T33	3		T215	5
values[4]	3200	1			T15	1		T215	1		T89	1
values[5]	1507	1			T215	1		T216	1		T354	4
values[6]	961	1			T354	2		T106	1		T87	1
values[7]	774	1			T340	5		T102	5		T68	11
values[8]	645	1			T340	2		T102	1		T68	5
values[9]	624	1			T340	2		T102	1		T68	10
values[10]	498	1			T340	1		T102	3		T68	8
values[11]	418	1			T340	4		T102	1		T68	12
values[12]	435	1			T340	12		T102	3		T68	4
values[13]	495	1			T340	20		T102	1		T68	5
values[14]	512	1			T340	22		T102	2		T68	11
values[15]	532	1			T340	25		T102	2		T68	20
values[16]	510	1			T340	21		T102	1		T68	17
values[17]	524	1			T340	18		T102	1		T68	10
values[18]	506	1			T340	16		T102	2		T68	10
values[19]	406	1			T340	10		T102	1		T68	8
values[20]	325	1			T340	5		T102	1		T68	10
values[21]	300	1			T340	1		T102	1		T68	5
values[22]	286	1			T340	2		T102	1		T68	11
values[23]	281	1			T340	3		T102	3		T68	7
values[24]	289	1			T340	3		T102	2		T68	7
values[25]	283	1			T340	3		T102	2		T68	7
values[26]	280	1			T340	2		T102	2		T68	6
values[27]	285	1			T340	3		T102	2		T68	2
values[28]	308	1			T340	2		T102	3		T68	2
values[29]	282	1			T340	2		T102	3		T68	4
values[30]	301	1			T340	3		T102	3		T68	6
values[31]	334	1			T340	13		T102	1		T68	10
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values[191]	2305	1			T102	107		T378	39		T368	284
values[192]	10875	1			T102	53		T378	410		T368	157