Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_main__ram_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1357170	1			T14	1027		T15	2018		T16	151
values[2]	82105	1			T15	234		T17	19		T18	2
values[3]	11798	1			T15	14		T17	5		T38	112
values[4]	3484	1			T17	1		T38	90		T91	2
values[5]	1531	1			T38	72		T72	35		T291	4
values[6]	976	1			T38	63		T72	43		T291	3
values[7]	778	1			T38	33		T72	25		T291	3
values[8]	701	1			T38	16		T72	32		T291	6
values[9]	584	1			T38	17		T72	25		T291	4
values[10]	512	1			T38	12		T72	32		T291	6
values[11]	501	1			T38	13		T72	32		T291	1
values[12]	426	1			T72	13		T291	3		T96	1
values[13]	461	1			T72	8		T291	10		T96	1
values[14]	511	1			T72	27		T291	9		T96	3
values[15]	489	1			T72	9		T291	5		T96	1
values[16]	472	1			T72	5		T291	4		T96	1
values[17]	456	1			T72	6		T291	6		T96	2
values[18]	487	1			T72	2		T291	2		T96	1
values[19]	474	1			T72	4		T291	13		T96	1
values[20]	444	1			T72	6		T291	11		T96	2
values[21]	403	1			T72	9		T291	5		T96	1
values[22]	421	1			T72	6		T291	2		T96	1
values[23]	454	1			T72	5		T291	1		T96	1
values[24]	423	1			T72	12		T291	2		T96	1
values[25]	389	1			T72	18		T291	1		T96	2
values[26]	395	1			T72	9		T291	5		T96	2
values[27]	393	1			T72	5		T291	5		T96	2
values[28]	395	1			T72	3		T291	5		T96	1
values[29]	397	1			T291	3		T96	2		T70	9
values[30]	351	1			T291	1		T96	1		T70	15
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