Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.usbdev_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	146004	1			T72	72		T73	1		T74	5
values[2]	9578	1			T72	5		T73	1		T223	1
values[3]	4641	1			T73	1		T367	23		T666	5
values[4]	2676	1			T73	1		T367	21		T836	1
values[5]	1654	1			T73	1		T367	32		T836	1
values[6]	1253	1			T73	1		T367	18		T836	1
values[7]	1040	1			T73	1		T367	12		T836	1
values[8]	877	1			T73	1		T367	12		T836	1
values[9]	682	1			T73	1		T367	22		T836	1
values[10]	671	1			T73	1		T367	11		T836	1
values[11]	642	1			T73	1		T367	1		T836	1
values[12]	594	1			T73	1		T367	6		T836	1
values[13]	474	1			T73	1		T367	9		T836	1
values[14]	536	1			T73	1		T367	7		T836	1
values[15]	487	1			T73	2		T367	10		T836	1
values[16]	563	1			T73	1		T367	4		T836	1
values[17]	510	1			T73	1		T367	3		T836	1
values[18]	432	1			T73	1		T367	2		T836	1
values[19]	475	1			T73	1		T367	2		T836	1
values[20]	448	1			T73	1		T836	1		T848	1
values[21]	429	1			T73	1		T836	1		T848	1
values[22]	363	1			T73	1		T836	1		T848	1
values[23]	396	1			T73	1		T836	1		T848	1
values[24]	414	1			T73	1		T836	1		T848	1
values[25]	391	1			T73	1		T836	1		T848	1
values[26]	353	1			T73	2		T836	1		T848	1
values[27]	407	1			T73	1		T836	1		T848	1
values[28]	376	1			T73	1		T836	1		T848	1
values[29]	415	1			T73	1		T836	1		T848	1
values[30]	385	1			T73	1		T836	1		T848	1
values[31]	365	1			T73	1		T836	1		T848	1
values[32]	315	1			T73	1		T836	1		T848	1
values[33]	306	1			T73	1		T836	1		T848	1
values[34]	311	1			T73	1		T836	1		T848	1
values[35]	355	1			T73	1		T836	1		T848	1
values[36]	339	1			T73	1		T836	1		T848	1
values[37]	316	1			T73	1		T836	1		T848	1
values[38]	309	1			T73	1		T836	1		T848	1
values[39]	384	1			T73	1		T836	1		T848	1
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values[41]	316	1			T73	1		T836	1		T848	1
values[42]	262	1			T73	1		T836	1		T848	1
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values[44]	202	1			T73	1		T836	1		T848	1
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values[47]	211	1			T73	1		T836	1		T848	1
values[48]	215	1			T73	1		T836	1		T848	1
values[49]	178	1			T73	1		T836	1		T848	1
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values[54]	65	1			T73	1		T836	1		T848	1
values[55]	56	1			T73	1		T836	1		T848	1
values[56]	54	1			T73	1		T836	1		T848	1
values[57]	59	1			T73	1		T836	1		T848	1
values[58]	67	1			T73	1		T836	1		T848	1
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values[61]	66	1			T73	1		T836	1		T848	1
values[62]	76	1			T73	1		T836	1		T848	1
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values[66]	53	1			T73	1		T836	1		T848	1
values[67]	57	1			T73	1		T836	1		T848	1
values[68]	67	1			T73	1		T836	1		T848	1
values[69]	62	1			T73	1		T836	1		T848	1
values[70]	65	1			T73	1		T836	1		T848	1
values[71]	84	1			T73	1		T836	1		T848	1
values[72]	84	1			T73	1		T836	1		T848	1
values[73]	65	1			T73	1		T836	1		T848	1
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values[77]	61	1			T73	1		T836	1		T848	1
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values[79]	66	1			T73	1		T836	1		T848	1
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values[111]	65	1			T73	2		T836	1		T848	1
values[112]	46	1			T73	1		T836	1		T848	1
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values[124]	49	1			T73	1		T836	1		T848	1
values[125]	62	1			T73	3		T836	2		T848	1
values[126]	116	1			T73	3		T836	5		T848	5
values[127]	1853	1			T73	55		T836	69		T848	52
values[128]	9048	1			T73	262		T836	248		T848	246