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Summary for Variable cp_num_of_outstanding

CATEGORYEXPECTEDUNCOVEREDCOVEREDPERCENT
User Defined Bins 128 0 128 100.00


User Defined Bins for cp_num_of_outstanding

Bins
NAMECOUNTAT LEASTSTATUSTESTCOUNTTESTCOUNTTESTCOUNT
values[1] 139680 1 T75 72 T76 1 T77 8
values[2] 12102 1 T76 1 T79 6 T401 10
values[3] 5175 1 T76 1 T387 73 T515 1
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values[8] 276 1 T76 1 T490 12 T804 1
values[9] 265 1 T76 1 T490 23 T804 1
values[10] 221 1 T76 1 T490 15 T804 1
values[11] 235 1 T76 1 T490 9 T804 1
values[12] 194 1 T76 1 T490 10 T804 1
values[13] 153 1 T76 1 T490 22 T804 1
values[14] 164 1 T76 1 T490 38 T804 1
values[15] 161 1 T76 1 T490 33 T804 1
values[16] 181 1 T76 1 T490 42 T804 1
values[17] 173 1 T76 1 T490 34 T804 1
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values[19] 131 1 T76 1 T490 16 T804 1
values[20] 132 1 T76 1 T490 16 T804 1
values[21] 163 1 T76 1 T490 18 T804 2
values[22] 168 1 T76 1 T490 24 T804 1
values[23] 137 1 T76 1 T490 16 T804 1
values[24] 128 1 T76 1 T490 19 T804 1
values[25] 120 1 T76 1 T490 31 T804 1
values[26] 141 1 T76 1 T490 56 T804 1
values[27] 117 1 T76 1 T490 30 T804 1
values[28] 105 1 T76 1 T490 13 T804 1
values[29] 85 1 T76 1 T490 20 T804 1
values[30] 90 1 T76 1 T490 26 T804 1
values[31] 67 1 T76 1 T490 7 T804 1
values[32] 77 1 T76 1 T490 13 T804 1
values[33] 68 1 T76 1 T490 11 T804 1
values[34] 125 1 T76 1 T490 16 T804 1
values[35] 122 1 T76 1 T490 12 T804 1
values[36] 87 1 T76 1 T490 7 T804 1
values[37] 99 1 T76 1 T490 24 T804 1
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values[39] 80 1 T76 1 T490 10 T804 1
values[40] 97 1 T76 1 T490 7 T804 1
values[41] 86 1 T76 1 T490 9 T804 1
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values[48] 123 1 T76 1 T490 15 T804 1
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values[52] 121 1 T76 1 T490 21 T804 1
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values[126] 270 1 T76 9 T804 10 T459 8
values[127] 2528 1 T76 98 T804 107 T459 118
values[128] 4888 1 T76 193 T804 201 T459 177

0% 10% 20% 30% 40% 50% 60% 70% 80% 90% 100%