Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_main__regs_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	165035	1			T75	302		T76	2		T80	3
values[2]	4125	1			T76	2		T131	1		T235	3
values[3]	2041	1			T76	2		T131	1		T546	1
values[4]	1515	1			T76	2		T131	1		T546	1
values[5]	1297	1			T76	2		T131	1		T546	1
values[6]	1160	1			T76	2		T131	1		T546	1
values[7]	997	1			T76	2		T131	1		T546	1
values[8]	938	1			T76	2		T131	1		T546	1
values[9]	823	1			T76	2		T131	1		T546	1
values[10]	744	1			T76	2		T131	1		T546	2
values[11]	640	1			T76	2		T131	1		T546	1
values[12]	594	1			T76	2		T131	1		T546	1
values[13]	665	1			T76	2		T131	1		T546	1
values[14]	631	1			T76	2		T131	1		T546	1
values[15]	580	1			T76	2		T131	1		T546	1
values[16]	561	1			T76	2		T131	1		T546	1
values[17]	528	1			T76	2		T131	1		T546	1
values[18]	398	1			T76	2		T131	1		T546	1
values[19]	337	1			T76	2		T131	1		T546	1
values[20]	266	1			T76	2		T131	1		T546	1
values[21]	244	1			T76	2		T131	1		T546	1
values[22]	240	1			T76	2		T131	1		T546	1
values[23]	255	1			T76	2		T131	1		T546	1
values[24]	253	1			T76	2		T131	1		T546	1
values[25]	264	1			T76	2		T131	1		T546	1
values[26]	258	1			T76	2		T131	1		T546	1
values[27]	230	1			T76	2		T131	1		T546	1
values[28]	179	1			T76	2		T131	1		T546	1
values[29]	146	1			T76	2		T131	1		T546	1
values[30]	172	1			T76	2		T131	1		T546	1
values[31]	159	1			T76	2		T131	1		T546	1
values[32]	166	1			T76	2		T131	1		T546	1
values[33]	134	1			T76	2		T131	1		T546	1
values[34]	125	1			T76	2		T131	1		T546	1
values[35]	130	1			T76	2		T131	1		T546	1
values[36]	118	1			T76	2		T131	1		T546	1
values[37]	112	1			T76	2		T131	1		T546	1
values[38]	95	1			T76	2		T131	1		T546	1
values[39]	79	1			T76	2		T131	1		T546	1
values[40]	91	1			T76	2		T131	1		T546	1
values[41]	84	1			T76	2		T131	1		T546	1
values[42]	77	1			T76	2		T131	1		T546	1
values[43]	68	1			T76	2		T131	1		T546	1
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values[45]	69	1			T76	2		T131	1		T546	1
values[46]	81	1			T76	2		T131	1		T546	1
values[47]	68	1			T76	2		T131	1		T546	1
values[48]	58	1			T76	2		T131	1		T546	1
values[49]	66	1			T76	2		T131	1		T546	1
values[50]	68	1			T76	2		T131	1		T546	1
values[51]	56	1			T76	2		T131	1		T546	1
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values[59]	44	1			T76	2		T131	1		T546	1
values[60]	53	1			T76	2		T131	1		T546	1
values[61]	46	1			T76	2		T131	1		T546	1
values[62]	51	1			T76	2		T131	1		T546	1
values[63]	54	1			T76	2		T131	1		T546	1
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values[69]	52	1			T76	2		T131	1		T546	1
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values[73]	61	1			T76	2		T131	1		T546	1
values[74]	57	1			T76	2		T131	1		T546	1
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values[77]	54	1			T76	2		T131	1		T546	1
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values[79]	51	1			T76	2		T131	1		T546	1
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values[83]	64	1			T76	2		T131	1		T546	1
values[84]	67	1			T76	2		T131	1		T546	1
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values[96]	79	1			T76	2		T131	4		T546	2
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values[99]	75	1			T76	2		T131	2		T546	2
values[100]	77	1			T76	2		T131	4		T546	1
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values[102]	81	1			T76	4		T131	2		T546	2
values[103]	81	1			T76	3		T131	2		T546	2
values[104]	88	1			T76	6		T131	4		T546	2
values[105]	84	1			T76	3		T131	3		T546	4
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values[107]	87	1			T76	2		T131	2		T546	3
values[108]	85	1			T76	3		T131	2		T546	2
values[109]	88	1			T76	3		T131	3		T546	3
values[110]	74	1			T76	2		T131	3		T546	1
values[111]	90	1			T76	4		T131	2		T546	1
values[112]	83	1			T76	4		T131	3		T546	2
values[113]	91	1			T76	5		T131	1		T546	1
values[114]	90	1			T76	3		T131	1		T546	3
values[115]	103	1			T76	2		T131	6		T546	8
values[116]	104	1			T76	3		T131	2		T546	4
values[117]	78	1			T76	3		T131	1		T546	2
values[118]	96	1			T76	3		T131	1		T546	3
values[119]	116	1			T76	3		T131	1		T546	4
values[120]	113	1			T76	4		T131	2		T546	1
values[121]	97	1			T76	5		T131	6		T546	2
values[122]	103	1			T76	9		T131	2		T546	1
values[123]	125	1			T76	5		T131	4		T546	5
values[124]	198	1			T76	4		T131	2		T546	2
values[125]	353	1			T76	2		T131	3		T546	2
values[126]	721	1			T76	17		T131	12		T546	16
values[127]	2516	1			T76	195		T131	95		T546	110
values[128]	4543	1			T76	425		T131	180		T546	209