Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.rv_dm__mem_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1420111	1			T75	3567		T76	257		T77	55
values[2]	79172	1			T76	77		T77	7		T156	102
values[3]	11166	1			T76	25		T156	5		T131	43
values[4]	3814	1			T76	8		T131	11		T235	1
values[5]	2108	1			T76	2		T131	2		T712	1
values[6]	1710	1			T76	1		T131	1		T546	2
values[7]	1438	1			T546	2		T545	44		T649	2
values[8]	1275	1			T546	2		T545	50		T649	3
values[9]	1170	1			T546	1		T545	31		T649	22
values[10]	1127	1			T546	1		T545	18		T649	25
values[11]	964	1			T546	1		T545	26		T649	25
values[12]	841	1			T546	1		T545	17		T649	31
values[13]	764	1			T546	1		T545	9		T649	36
values[14]	764	1			T546	1		T545	41		T649	40
values[15]	775	1			T546	1		T545	43		T649	50
values[16]	839	1			T546	1		T545	42		T649	82
values[17]	761	1			T546	1		T545	26		T649	56
values[18]	701	1			T546	1		T545	18		T649	36
values[19]	637	1			T546	1		T545	13		T649	14
values[20]	611	1			T546	1		T545	37		T649	11
values[21]	511	1			T546	1		T545	34		T649	8
values[22]	388	1			T546	1		T545	31		T649	3
values[23]	415	1			T546	1		T545	25		T649	10
values[24]	450	1			T546	1		T545	37		T649	14
values[25]	414	1			T546	1		T545	44		T649	7
values[26]	332	1			T546	1		T545	18		T649	2
values[27]	313	1			T546	1		T545	7		T802	1
values[28]	267	1			T546	1		T545	5		T802	1
values[29]	253	1			T546	1		T545	3		T802	2
values[30]	201	1			T546	1		T802	1		T798	18
values[31]	223	1			T546	1		T802	3		T798	19
values[32]	202	1			T546	1		T802	1		T798	27
values[33]	167	1			T546	1		T802	2		T798	27
values[34]	134	1			T546	1		T802	1		T798	15
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values[39]	191	1			T546	1		T802	1		T798	11
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values[52]	107	1			T546	1		T802	2		T804	2
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values[192]	9314	1			T546	282		T802	4		T804	7