Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.rv_dm__mem_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1348893	1			T72	1194		T73	753		T74	877
values[2]	76931	1			T73	216		T74	82		T77	3
values[3]	11662	1			T73	64		T74	2		T78	2
values[4]	4105	1			T73	17		T78	2		T287	1
values[5]	2164	1			T73	5		T738	1		T740	1
values[6]	1537	1			T73	1		T422	4		T739	5
values[7]	1371	1			T422	3		T739	7		T807	3
values[8]	1172	1			T422	2		T739	7		T807	1
values[9]	1095	1			T422	2		T739	8		T807	1
values[10]	1019	1			T422	2		T739	19		T807	1
values[11]	880	1			T422	2		T739	25		T807	1
values[12]	883	1			T422	2		T739	29		T807	1
values[13]	845	1			T422	2		T739	35		T807	1
values[14]	794	1			T422	2		T739	29		T807	1
values[15]	785	1			T422	2		T739	26		T807	1
values[16]	742	1			T422	2		T739	26		T807	1
values[17]	629	1			T422	2		T739	35		T807	1
values[18]	661	1			T422	2		T739	61		T807	1
values[19]	682	1			T422	2		T739	23		T807	1
values[20]	741	1			T422	2		T739	13		T807	1
values[21]	701	1			T422	2		T739	6		T807	1
values[22]	621	1			T422	2		T739	7		T807	1
values[23]	654	1			T422	2		T739	15		T807	1
values[24]	624	1			T422	2		T739	6		T807	1
values[25]	531	1			T422	2		T739	6		T807	1
values[26]	435	1			T422	2		T739	6		T807	1
values[27]	408	1			T422	2		T739	12		T807	1
values[28]	348	1			T422	2		T739	6		T807	1
values[29]	321	1			T422	2		T739	6		T807	1
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values[190]	1140	1			T422	29		T807	15		T810	229
values[191]	3775	1			T422	279		T807	189		T810	151
values[192]	6497	1			T422	574		T807	356		T810	10