Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_main__ram_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1328783	1			T72	1170		T73	708		T74	803
values[2]	75216	1			T73	213		T74	101		T77	5
values[3]	10019	1			T73	46		T74	13		T77	1
values[4]	2629	1			T73	12		T74	10		T287	8
values[5]	1028	1			T73	3		T74	6		T287	2
values[6]	602	1			T73	1		T74	3		T287	2
values[7]	492	1			T73	1		T74	4		T287	2
values[8]	414	1			T73	1		T74	5		T450	6
values[9]	388	1			T73	1		T74	4		T450	2
values[10]	406	1			T73	1		T74	17		T450	1
values[11]	411	1			T73	1		T74	4		T450	1
values[12]	384	1			T73	1		T74	1		T450	2
values[13]	376	1			T73	1		T74	2		T450	4
values[14]	377	1			T73	1		T74	1		T450	3
values[15]	318	1			T73	1		T74	4		T450	5
values[16]	329	1			T73	1		T74	5		T450	7
values[17]	308	1			T73	1		T74	4		T450	11
values[18]	329	1			T73	1		T74	4		T450	13
values[19]	324	1			T73	1		T74	7		T450	10
values[20]	371	1			T73	1		T74	3		T450	13
values[21]	363	1			T73	1		T74	3		T450	5
values[22]	345	1			T73	1		T74	11		T450	2
values[23]	334	1			T73	1		T74	8		T450	1
values[24]	343	1			T73	1		T74	4		T450	2
values[25]	312	1			T73	1		T74	4		T450	1
values[26]	285	1			T73	1		T74	2		T450	1
values[27]	301	1			T73	1		T74	4		T450	2
values[28]	318	1			T73	1		T74	7		T450	5
values[29]	344	1			T73	1		T74	13		T450	10
values[30]	282	1			T73	1		T74	8		T450	2
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values[35]	261	1			T73	1		T74	8		T450	1
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values[192]	9549	1			T73	471		T650	70		T836	406