Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.alert_handler_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
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Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	158603	1			T78	8		T79	6		T80	269
values[2]	5023	1			T83	3		T462	2		T455	3
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values[111]	103	1			T569	4		T862	6		T863	4
values[112]	117	1			T569	6		T862	14		T863	3
values[113]	111	1			T569	4		T862	10		T863	1
values[114]	87	1			T569	2		T862	2		T863	2
values[115]	110	1			T569	1		T862	6		T863	4
values[116]	103	1			T569	5		T862	8		T863	1
values[117]	86	1			T569	3		T862	1		T863	2
values[118]	110	1			T569	6		T862	7		T863	3
values[119]	95	1			T569	3		T862	5		T863	3
values[120]	107	1			T569	3		T862	1		T863	4
values[121]	124	1			T569	10		T862	3		T863	4
values[122]	132	1			T569	6		T862	4		T863	8
values[123]	138	1			T569	3		T862	11		T863	2
values[124]	235	1			T569	23		T862	33		T863	7
values[125]	551	1			T569	52		T862	43		T863	41
values[126]	1078	1			T569	107		T862	59		T863	63
values[127]	3367	1			T569	43		T862	29		T863	42
values[128]	5562	1			T862	1		T863	8		T864	205

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	136957	1			T78	2		T79	4		T80	224
values[2]	8956	1			T83	6		T462	5		T540	8
values[3]	3643	1			T416	7		T653	89		T865	3
values[4]	2274	1			T416	9		T653	62		T865	3
values[5]	1562	1			T416	7		T653	45		T865	2
values[6]	1155	1			T416	5		T653	31		T858	5
values[7]	806	1			T416	6		T653	33		T858	9
values[8]	658	1			T416	10		T653	10		T858	12
values[9]	523	1			T416	11		T866	2		T867	3
values[10]	429	1			T416	9		T866	2		T867	1
values[11]	353	1			T416	4		T866	2		T867	1
values[12]	348	1			T416	4		T866	2		T867	2
values[13]	315	1			T416	3		T866	2		T867	3
values[14]	308	1			T416	10		T866	2		T867	2
values[15]	329	1			T416	11		T866	2		T867	2
values[16]	351	1			T416	18		T866	2		T867	3
values[17]	338	1			T416	6		T866	2		T867	4
values[18]	320	1			T416	5		T866	2		T867	2
values[19]	308	1			T416	9		T866	2		T867	1
values[20]	320	1			T416	5		T866	2		T867	2
values[21]	323	1			T416	3		T866	2		T867	2
values[22]	344	1			T416	7		T866	2		T867	4
values[23]	289	1			T416	8		T866	2		T867	1
values[24]	331	1			T416	6		T866	2		T867	5
values[25]	317	1			T416	6		T866	2		T867	10
values[26]	349	1			T416	8		T866	2		T867	1
values[27]	302	1			T416	6		T866	2		T867	1
values[28]	314	1			T416	11		T866	2		T867	2
values[29]	293	1			T416	9		T866	2		T867	2
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values[31]	300	1			T416	13		T866	2		T867	1
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values[33]	317	1			T416	3		T866	2		T867	3
values[34]	360	1			T416	5		T866	2		T867	1
values[35]	287	1			T416	7		T866	2		T867	2
values[36]	304	1			T416	10		T866	2		T867	4
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values[43]	275	1			T416	4		T866	2		T867	1
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values[48]	306	1			T416	5		T866	2		T867	2
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values[51]	326	1			T416	6		T866	2		T867	1
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values[75]	97	1			T866	2		T867	4		T487	1
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values[77]	125	1			T866	2		T867	11		T487	7
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values[80]	87	1			T866	2		T867	13		T487	5
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