Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_main__ram_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1330634	1			T85	679		T86	294		T87	479
values[2]	79073	1			T85	73		T86	49		T87	143
values[3]	11281	1			T85	5		T86	2		T87	51
values[4]	3417	1			T85	2		T87	12		T486	11
values[5]	1575	1			T87	4		T486	10		T546	1
values[6]	919	1			T87	3		T486	7		T546	1
values[7]	703	1			T87	1		T486	6		T546	1
values[8]	625	1			T87	1		T486	12		T551	2
values[9]	493	1			T87	1		T486	12		T551	2
values[10]	430	1			T87	1		T486	4		T551	2
values[11]	438	1			T87	1		T486	2		T551	2
values[12]	429	1			T87	1		T486	5		T551	2
values[13]	473	1			T87	1		T486	5		T551	2
values[14]	416	1			T87	1		T486	3		T551	2
values[15]	382	1			T87	1		T486	2		T551	2
values[16]	372	1			T87	1		T486	5		T551	2
values[17]	371	1			T87	1		T486	3		T551	2
values[18]	479	1			T87	1		T486	6		T551	2
values[19]	452	1			T87	1		T486	14		T551	2
values[20]	401	1			T87	1		T486	13		T551	2
values[21]	318	1			T87	1		T486	9		T551	2
values[22]	313	1			T87	1		T486	6		T551	2
values[23]	322	1			T87	1		T486	6		T551	2
values[24]	279	1			T87	1		T486	3		T551	2
values[25]	281	1			T87	1		T486	2		T551	2
values[26]	360	1			T87	1		T486	2		T551	2
values[27]	339	1			T87	1		T486	5		T551	2
values[28]	332	1			T87	1		T486	9		T551	2
values[29]	371	1			T87	1		T486	2		T551	2
values[30]	307	1			T87	1		T486	5		T551	2
values[31]	281	1			T87	1		T486	7		T551	2
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values[34]	264	1			T87	1		T486	1		T551	2
values[35]	341	1			T87	1		T486	7		T551	2
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values[92]	197	1			T87	1		T486	6		T551	2
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values[192]	8807	1			T87	503		T551	882		T820	52