Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.rv_dm__mem_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1371427	1			T78	666		T79	38		T80	42
values[2]	78937	1			T80	5		T84	325		T251	157
values[3]	10935	1			T80	2		T84	66		T251	42
values[4]	3986	1			T84	18		T251	11		T570	16
values[5]	2226	1			T84	37		T251	3		T570	8
values[6]	1522	1			T84	32		T251	3		T570	2
values[7]	1237	1			T84	22		T251	1		T570	2
values[8]	1154	1			T84	16		T251	1		T570	2
values[9]	1093	1			T84	18		T570	2		T450	16
values[10]	992	1			T84	24		T570	2		T450	15
values[11]	884	1			T84	38		T570	2		T450	4
values[12]	845	1			T84	37		T570	2		T450	4
values[13]	818	1			T84	26		T570	2		T450	8
values[14]	738	1			T84	22		T570	2		T450	9
values[15]	696	1			T84	11		T570	2		T450	3
values[16]	676	1			T84	18		T570	2		T450	5
values[17]	635	1			T84	28		T570	2		T450	11
values[18]	606	1			T84	17		T570	2		T450	12
values[19]	623	1			T84	19		T570	2		T450	12
values[20]	559	1			T84	32		T570	2		T450	12
values[21]	553	1			T84	16		T570	2		T450	17
values[22]	496	1			T84	18		T570	2		T450	27
values[23]	458	1			T84	18		T570	2		T450	27
values[24]	476	1			T84	19		T570	2		T450	38
values[25]	477	1			T84	17		T570	2		T450	30
values[26]	471	1			T84	19		T570	2		T450	15
values[27]	450	1			T84	14		T570	2		T450	12
values[28]	399	1			T84	21		T570	2		T450	4
values[29]	413	1			T84	23		T570	2		T450	7
values[30]	399	1			T84	14		T570	2		T450	13
values[31]	396	1			T84	20		T570	2		T450	5
values[32]	346	1			T84	10		T570	2		T450	4
values[33]	307	1			T84	9		T570	2		T497	2
values[34]	212	1			T84	7		T570	2		T497	5
values[35]	147	1			T84	11		T570	2		T497	3
values[36]	172	1			T84	1		T570	2		T497	3
values[37]	157	1			T570	2		T497	4		T825	1
values[38]	120	1			T570	2		T497	1		T825	1
values[39]	121	1			T570	2		T497	3		T825	1
values[40]	147	1			T570	2		T497	10		T825	1
values[41]	133	1			T570	2		T497	24		T825	1
values[42]	144	1			T570	2		T497	13		T825	1
values[43]	150	1			T570	2		T497	8		T825	1
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values[45]	178	1			T570	2		T497	7		T825	1
values[46]	136	1			T570	2		T497	8		T825	1
values[47]	103	1			T570	2		T497	4		T825	1
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values[49]	81	1			T570	2		T497	4		T825	1
values[50]	85	1			T570	2		T497	7		T825	1
values[51]	89	1			T570	2		T497	4		T825	1
values[52]	114	1			T570	2		T497	11		T825	1
values[53]	128	1			T570	2		T497	23		T825	1
values[54]	113	1			T570	3		T497	29		T825	1
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values[56]	113	1			T570	2		T497	25		T825	1
values[57]	96	1			T570	2		T497	13		T825	1
values[58]	83	1			T570	2		T497	6		T825	1
values[59]	80	1			T570	2		T497	11		T825	1
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values[61]	119	1			T570	2		T497	22		T825	2
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values[68]	66	1			T570	2		T825	1		T665	1
values[69]	56	1			T570	2		T825	1		T723	1
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values[166]	65	1			T570	2		T825	1		T488	2
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values[190]	782	1			T570	41		T825	7		T488	98
values[191]	3642	1			T570	330		T825	114		T488	51
values[192]	6561	1			T570	602		T825	256		T488	3