Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.rv_dm__mem_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1331446	1			T81	37		T82	476		T83	42
values[2]	77481	1			T81	7		T82	63		T134	28
values[3]	10871	1			T82	2		T134	2		T135	5
values[4]	4101	1			T561	2		T552	1		T551	97
values[5]	2652	1			T561	1		T551	58		T909	2
values[6]	2102	1			T551	43		T909	1		T583	11
values[7]	1848	1			T551	33		T583	1		T559	6
values[8]	1798	1			T551	36		T583	8		T559	7
values[9]	1556	1			T551	54		T583	17		T559	7
values[10]	1245	1			T551	49		T583	11		T559	10
values[11]	1143	1			T551	32		T583	16		T559	23
values[12]	1038	1			T551	32		T583	10		T559	10
values[13]	872	1			T551	6		T583	9		T559	20
values[14]	795	1			T551	2		T583	5		T559	15
values[15]	669	1			T583	4		T559	14		T906	40
values[16]	597	1			T583	5		T559	47		T906	26
values[17]	557	1			T583	14		T559	49		T906	18
values[18]	590	1			T583	29		T559	30		T906	24
values[19]	572	1			T583	49		T559	26		T906	40
values[20]	560	1			T583	26		T559	42		T906	34
values[21]	576	1			T583	3		T559	29		T906	63
values[22]	534	1			T583	7		T559	19		T906	78
values[23]	521	1			T583	1		T559	15		T906	99
values[24]	408	1			T583	4		T559	7		T906	57
values[25]	327	1			T583	4		T559	8		T906	31
values[26]	370	1			T583	8		T559	9		T906	24
values[27]	360	1			T583	6		T559	2		T906	25
values[28]	340	1			T583	7		T906	13		T773	45
values[29]	295	1			T583	7		T906	20		T773	32
values[30]	276	1			T583	15		T906	18		T773	22
values[31]	304	1			T583	59		T906	23		T773	11
values[32]	287	1			T583	86		T906	8		T773	5
values[33]	279	1			T583	52		T906	6		T773	8
values[34]	232	1			T583	24		T906	1		T773	15
values[35]	283	1			T583	33		T906	3		T773	20
values[36]	266	1			T583	20		T906	2		T773	8
values[37]	251	1			T583	14		T906	1		T773	8
values[38]	229	1			T906	4		T773	14		T686	8
values[39]	255	1			T906	29		T773	21		T686	3
values[40]	232	1			T906	16		T773	15		T686	6
values[41]	238	1			T906	14		T773	12		T686	2
values[42]	225	1			T906	19		T773	4		T686	16
values[43]	174	1			T906	16		T773	1		T686	24
values[44]	178	1			T906	12		T773	1		T686	13
values[45]	142	1			T906	6		T773	4		T686	8
values[46]	154	1			T906	6		T773	4		T686	14
values[47]	120	1			T906	4		T773	4		T686	9
values[48]	121	1			T906	11		T773	5		T686	13
values[49]	128	1			T906	6		T773	9		T686	19
values[50]	114	1			T906	3		T773	10		T686	16
values[51]	133	1			T906	5		T773	21		T686	23
values[52]	103	1			T906	23		T773	15		T686	2
values[53]	95	1			T906	17		T773	17		T890	2
values[54]	80	1			T906	4		T773	2		T890	1
values[55]	88	1			T906	3		T773	2		T890	1
values[56]	85	1			T906	1		T773	5		T890	1
values[57]	119	1			T906	1		T773	7		T890	1
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values[59]	141	1			T906	10		T773	11		T890	1
values[60]	120	1			T906	7		T773	12		T890	1
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values[64]	121	1			T773	8		T890	1		T482	2
values[65]	103	1			T773	5		T890	1		T482	2
values[66]	77	1			T773	7		T890	1		T482	2
values[67]	56	1			T890	1		T482	3		T935	1
values[68]	60	1			T890	1		T482	3		T935	1
values[69]	50	1			T890	1		T482	2		T935	1
values[70]	86	1			T890	1		T482	2		T935	1
values[71]	100	1			T890	1		T482	3		T935	1
values[72]	99	1			T890	1		T482	7		T935	1
values[73]	78	1			T890	1		T482	1		T935	1
values[74]	72	1			T890	1		T482	1		T935	1
values[75]	67	1			T890	1		T482	2		T935	1
values[76]	77	1			T890	1		T482	4		T935	1
values[77]	84	1			T890	1		T482	1		T935	1
values[78]	75	1			T890	1		T482	2		T935	1
values[79]	89	1			T890	1		T482	1		T935	1
values[80]	79	1			T890	1		T482	4		T935	1
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values[103]	35	1			T890	1		T482	1		T935	1
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values[107]	34	1			T890	1		T482	1		T935	1
values[108]	36	1			T890	1		T482	1		T935	1
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values[110]	41	1			T890	1		T482	2		T935	1
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values[188]	181	1			T890	3		T482	22		T935	1
values[189]	454	1			T890	1		T482	62		T935	2
values[190]	884	1			T890	7		T482	113		T935	16
values[191]	2593	1			T890	148		T482	74		T935	144
values[192]	4130	1			T890	306		T482	4		T935	251