Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.pinmux_aon_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	143786	1			T72	54		T73	8		T74	7
values[2]	8702	1			T72	3		T214	1		T258	5
values[3]	2931	1			T441	1		T447	1		T552	27
values[4]	1895	1			T441	1		T447	1		T552	5
values[5]	1263	1			T441	1		T447	1		T552	4
values[6]	1017	1			T441	1		T447	1		T552	2
values[7]	785	1			T441	1		T447	1		T552	3
values[8]	581	1			T441	1		T447	1		T552	8
values[9]	471	1			T441	1		T447	1		T552	3
values[10]	469	1			T441	1		T447	1		T472	1
values[11]	371	1			T441	1		T447	1		T478	1
values[12]	395	1			T441	1		T447	1		T478	1
values[13]	387	1			T441	1		T447	1		T478	1
values[14]	387	1			T441	1		T447	1		T478	1
values[15]	359	1			T441	1		T447	1		T478	1
values[16]	311	1			T441	1		T447	1		T478	1
values[17]	318	1			T441	1		T447	1		T478	1
values[18]	363	1			T441	1		T447	1		T478	1
values[19]	303	1			T441	1		T447	1		T478	1
values[20]	321	1			T441	1		T447	1		T478	1
values[21]	326	1			T441	2		T447	1		T478	1
values[22]	327	1			T441	1		T447	1		T478	1
values[23]	298	1			T441	1		T447	1		T478	1
values[24]	397	1			T441	1		T447	1		T478	1
values[25]	343	1			T441	1		T447	1		T478	1
values[26]	303	1			T441	1		T447	1		T478	1
values[27]	333	1			T441	1		T447	1		T478	1
values[28]	321	1			T441	1		T447	2		T478	1
values[29]	320	1			T441	1		T447	1		T478	1
values[30]	368	1			T441	1		T447	1		T478	1
values[31]	357	1			T441	1		T447	1		T478	1
values[32]	331	1			T441	1		T447	1		T478	1
values[33]	327	1			T441	1		T447	1		T478	1
values[34]	313	1			T441	1		T447	1		T478	1
values[35]	317	1			T441	1		T447	1		T478	1
values[36]	339	1			T441	1		T447	1		T478	1
values[37]	312	1			T441	1		T447	1		T478	1
values[38]	299	1			T441	1		T447	1		T478	1
values[39]	292	1			T441	1		T447	2		T478	2
values[40]	319	1			T441	1		T447	1		T478	1
values[41]	317	1			T441	1		T447	1		T478	1
values[42]	321	1			T441	1		T447	1		T478	1
values[43]	287	1			T441	1		T447	1		T478	1
values[44]	321	1			T441	1		T447	1		T478	1
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values[46]	318	1			T441	1		T447	1		T478	1
values[47]	267	1			T441	1		T447	1		T478	1
values[48]	331	1			T441	1		T447	1		T478	1
values[49]	264	1			T441	1		T447	1		T478	1
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values[54]	237	1			T441	1		T447	1		T478	1
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values[56]	297	1			T441	1		T447	1		T478	1
values[57]	288	1			T441	1		T447	1		T478	1
values[58]	238	1			T441	1		T447	1		T478	1
values[59]	235	1			T441	1		T447	1		T478	1
values[60]	258	1			T441	1		T447	1		T478	1
values[61]	258	1			T441	1		T447	1		T478	1
values[62]	241	1			T441	1		T447	1		T478	1
values[63]	234	1			T441	1		T447	1		T478	1
values[64]	215	1			T441	1		T447	1		T478	1
values[65]	156	1			T441	1		T447	1		T478	1
values[66]	163	1			T441	1		T447	1		T478	1
values[67]	187	1			T441	1		T447	1		T478	1
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values[69]	126	1			T441	1		T447	1		T478	1
values[70]	149	1			T441	1		T447	1		T478	1
values[71]	143	1			T441	1		T447	1		T478	1
values[72]	136	1			T441	1		T447	1		T478	1
values[73]	117	1			T441	1		T447	1		T478	1
values[74]	128	1			T441	1		T447	1		T478	1
values[75]	135	1			T441	1		T447	1		T478	1
values[76]	123	1			T441	1		T447	1		T478	1
values[77]	133	1			T441	1		T447	1		T478	1
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values[79]	104	1			T441	1		T447	1		T478	1
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values[89]	110	1			T441	1		T447	8		T478	1
values[90]	85	1			T441	1		T447	4		T478	1
values[91]	92	1			T441	1		T447	5		T478	1
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values[111]	71	1			T441	1		T447	1		T478	1
values[112]	71	1			T441	1		T447	1		T478	1
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values[123]	75	1			T441	1		T447	6		T478	3
values[124]	59	1			T441	1		T447	1		T478	2
values[125]	79	1			T441	1		T447	1		T478	1
values[126]	162	1			T441	1		T447	2		T478	2
values[127]	812	1			T441	20		T447	24		T478	38
values[128]	5708	1			T441	297		T447	279		T478	302