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Summary for Variable cp_num_of_outstanding

CATEGORYEXPECTEDUNCOVEREDCOVEREDPERCENT
User Defined Bins 128 0 128 100.00


User Defined Bins for cp_num_of_outstanding

Bins
NAMECOUNTAT LEASTSTATUSTESTCOUNTTESTCOUNTTESTCOUNT
values[1] 154026 1 T78 304 T79 7 T80 2
values[2] 4237 1 T78 5 T84 36 T458 2
values[3] 1997 1 T84 31 T672 1 T817 21
values[4] 1492 1 T84 47 T672 1 T817 9
values[5] 1168 1 T84 41 T672 1 T817 14
values[6] 837 1 T84 30 T672 1 T817 10
values[7] 687 1 T84 9 T672 2 T817 9
values[8] 573 1 T84 12 T672 1 T817 10
values[9] 545 1 T84 12 T672 1 T817 8
values[10] 585 1 T84 18 T672 1 T817 7
values[11] 587 1 T84 17 T672 1 T817 6
values[12] 470 1 T84 19 T672 1 T817 5
values[13] 420 1 T84 34 T672 1 T817 1
values[14] 353 1 T84 22 T672 1 T460 3
values[15] 365 1 T84 8 T672 1 T460 1
values[16] 396 1 T84 9 T672 1 T460 2
values[17] 330 1 T84 5 T672 1 T460 5
values[18] 348 1 T672 1 T460 4 T476 14
values[19] 369 1 T672 1 T460 1 T476 11
values[20] 315 1 T672 1 T460 2 T476 16
values[21] 296 1 T672 1 T460 2 T476 6
values[22] 260 1 T672 1 T460 1 T476 2
values[23] 173 1 T672 1 T460 3 T826 7
values[24] 169 1 T672 1 T460 3 T826 1
values[25] 158 1 T672 1 T460 7 T833 15
values[26] 140 1 T672 1 T460 4 T833 29
values[27] 121 1 T672 1 T460 1 T833 37
values[28] 108 1 T672 1 T460 2 T833 20
values[29] 110 1 T672 1 T460 2 T833 16
values[30] 123 1 T672 1 T460 3 T833 10
values[31] 133 1 T672 1 T460 1 T833 14
values[32] 120 1 T672 1 T460 1 T833 15
values[33] 131 1 T672 1 T460 2 T833 18
values[34] 132 1 T672 1 T460 1 T833 31
values[35] 119 1 T672 1 T460 2 T833 11
values[36] 121 1 T672 1 T460 5 T833 6
values[37] 108 1 T672 1 T460 4 T839 2
values[38] 120 1 T672 1 T460 4 T839 1
values[39] 113 1 T672 1 T460 3 T839 1
values[40] 117 1 T672 1 T460 3 T839 3
values[41] 100 1 T672 1 T460 1 T839 5
values[42] 79 1 T672 1 T460 2 T839 6
values[43] 72 1 T672 1 T460 6 T839 6
values[44] 79 1 T672 1 T460 5 T839 5
values[45] 81 1 T672 1 T460 4 T839 2
values[46] 92 1 T672 1 T460 1 T839 3
values[47] 106 1 T672 1 T460 3 T839 5
values[48] 90 1 T672 1 T460 2 T839 2
values[49] 83 1 T672 1 T460 3 T839 4
values[50] 77 1 T672 1 T460 2 T839 2
values[51] 75 1 T672 1 T460 1 T839 2
values[52] 69 1 T672 1 T460 2 T839 3
values[53] 62 1 T672 1 T460 1 T839 1
values[54] 63 1 T672 1 T460 2 T839 3
values[55] 74 1 T672 1 T460 2 T839 3
values[56] 85 1 T672 1 T460 4 T839 4
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values[58] 58 1 T672 1 T460 6 T839 6
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values[60] 47 1 T672 1 T460 3 T839 1
values[61] 44 1 T672 1 T460 3 T839 2
values[62] 52 1 T672 1 T460 5 T839 1
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values[64] 59 1 T672 1 T460 5 T839 5
values[65] 46 1 T672 1 T460 2 T839 2
values[66] 43 1 T672 1 T460 2 T839 2
values[67] 57 1 T672 1 T460 4 T839 1
values[68] 44 1 T672 1 T460 2 T839 1
values[69] 51 1 T672 1 T460 4 T839 4
values[70] 56 1 T672 1 T460 4 T839 4
values[71] 48 1 T672 1 T460 4 T839 2
values[72] 56 1 T672 1 T460 1 T839 3
values[73] 47 1 T672 1 T460 2 T839 2
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values[82] 65 1 T672 1 T460 4 T839 2
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values[120] 85 1 T672 1 T460 5 T839 5
values[121] 86 1 T672 2 T460 4 T839 2
values[122] 91 1 T672 1 T460 3 T839 5
values[123] 105 1 T672 2 T460 9 T839 3
values[124] 229 1 T672 4 T460 28 T839 15
values[125] 399 1 T672 3 T460 41 T839 58
values[126] 805 1 T672 13 T460 58 T839 74
values[127] 3072 1 T672 105 T460 40 T839 36
values[128] 5478 1 T672 245 T460 7 T839 5

0% 10% 20% 30% 40% 50% 60% 70% 80% 90% 100%