Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_main__ram_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1260025	1			T78	443		T79	34		T80	427
values[2]	78356	1			T79	10		T82	2		T210	2
values[3]	10655	1			T79	4		T442	7		T513	1
values[4]	3066	1			T79	1		T442	2		T504	31
values[5]	1423	1			T442	1		T504	21		T521	3
values[6]	963	1			T442	1		T504	22		T810	1
values[7]	803	1			T442	2		T504	25		T903	1
values[8]	669	1			T442	2		T504	19		T903	1
values[9]	574	1			T442	1		T504	13		T903	1
values[10]	596	1			T442	1		T504	5		T903	1
values[11]	585	1			T504	5		T903	1		T725	15
values[12]	501	1			T504	12		T903	1		T725	6
values[13]	552	1			T504	25		T903	1		T725	7
values[14]	531	1			T504	28		T903	1		T725	7
values[15]	485	1			T504	17		T903	1		T725	8
values[16]	454	1			T504	21		T903	1		T725	8
values[17]	452	1			T504	23		T903	1		T725	3
values[18]	408	1			T504	18		T903	1		T725	2
values[19]	330	1			T504	8		T903	1		T725	1
values[20]	318	1			T504	7		T903	1		T725	2
values[21]	357	1			T504	3		T903	1		T725	1
values[22]	314	1			T504	2		T903	1		T725	1
values[23]	329	1			T504	9		T903	1		T725	7
values[24]	350	1			T504	16		T903	1		T725	7
values[25]	340	1			T504	10		T903	1		T725	4
values[26]	370	1			T504	6		T903	1		T725	2
values[27]	353	1			T504	2		T903	1		T725	2
values[28]	313	1			T504	3		T903	1		T725	2
values[29]	290	1			T504	6		T903	1		T725	2
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values[33]	352	1			T504	4		T903	1		T725	2
values[34]	370	1			T504	4		T903	1		T725	2
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values[192]	9932	1			T903	401		T889	427		T912	5