Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.sram_ctrl_main__ram_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	192	0	192	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	1376800	1			T92	62		T93	24		T94	140
values[2]	78783	1			T93	5		T99	3		T249	7
values[3]	11083	1			T93	2		T249	2		T467	1
values[4]	3230	1			T249	1		T561	1		T443	4
values[5]	1564	1			T249	1		T443	7		T575	1
values[6]	948	1			T443	9		T575	2		T592	2
values[7]	768	1			T443	4		T575	2		T592	3
values[8]	633	1			T443	11		T575	1		T665	16
values[9]	533	1			T443	16		T575	1		T665	20
values[10]	502	1			T443	16		T665	25		T628	2
values[11]	497	1			T443	1		T665	10		T628	5
values[12]	460	1			T443	2		T665	6		T628	3
values[13]	426	1			T443	2		T665	7		T628	3
values[14]	395	1			T443	1		T665	4		T628	3
values[15]	400	1			T443	9		T665	9		T628	3
values[16]	361	1			T443	4		T665	9		T628	4
values[17]	387	1			T443	8		T665	4		T628	4
values[18]	407	1			T443	11		T665	2		T628	5
values[19]	398	1			T443	20		T665	11		T628	9
values[20]	354	1			T443	14		T665	22		T628	9
values[21]	262	1			T443	2		T665	5		T628	5
values[22]	321	1			T443	6		T665	9		T628	20
values[23]	304	1			T443	11		T665	7		T628	21
values[24]	255	1			T443	9		T665	4		T628	17
values[25]	315	1			T443	11		T665	2		T628	31
values[26]	339	1			T443	8		T665	1		T628	69
values[27]	321	1			T443	1		T665	2		T628	51
values[28]	332	1			T443	4		T665	2		T628	51
values[29]	320	1			T443	5		T665	2		T628	43
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values[35]	408	1			T443	3		T665	8		T628	22
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values[71]	210	1			T443	3		T665	6		T808	1
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values[73]	239	1			T443	13		T665	4		T808	1
values[74]	221	1			T443	7		T665	7		T808	1
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values[189]	155	1			T808	3		T835	1		T473	2
values[190]	446	1			T808	2		T835	3		T473	3
values[191]	1404	1			T808	41		T835	30		T473	32
values[192]	9536	1			T808	508		T835	396		T473	424