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ASSERTIONS	CATEGORY	SEVERITY	ATTEMPTS	REAL SUCCESSES	FAILURES	INCOMPLETE
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tb.dut.u_s1n_28.gen_err_resp.err_resp.u_intg_gen.DataWidthCheck_A	0	0	900	900	0	0
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---

Detail Report for Cover Sequences

Cover Sequences All Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_adc_ctrl_aon.gen_host_cov.b2bRsp_C	0	0	312450685	7853	7853	0
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tb.dut.tlul_assert_device_adc_ctrl_aon.gen_host_cov.d_dataChangedNotAccepted_C	0	0	312450685	619	619	0
tb.dut.tlul_assert_device_adc_ctrl_aon.gen_host_cov.d_errorChangedNotAccepted_C	0	0	312450685	244	244	0
tb.dut.tlul_assert_device_adc_ctrl_aon.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	71	71	0
tb.dut.tlul_assert_device_adc_ctrl_aon.gen_host_cov.d_sinkChangedNotAccepted_C	0	0	312450685	297	297	0
tb.dut.tlul_assert_device_adc_ctrl_aon.gen_host_cov.d_sizeChangedNotAccepted_C	0	0	312450685	116	116	0
tb.dut.tlul_assert_device_adc_ctrl_aon.gen_host_cov.d_sourceChangedNotAccepted_C	0	0	312450685	168	168	0
tb.dut.tlul_assert_device_alert_handler.gen_host_cov.b2bRsp_C	0	0	312450685	8858	8858	0
tb.dut.tlul_assert_device_alert_handler.gen_host_cov.dValidNotAccepted_C	0	0	312450685	2328	2328	0
tb.dut.tlul_assert_device_alert_handler.gen_host_cov.d_dataChangedNotAccepted_C	0	0	312450685	784	784	0
tb.dut.tlul_assert_device_alert_handler.gen_host_cov.d_errorChangedNotAccepted_C	0	0	312450685	294	294	0
tb.dut.tlul_assert_device_alert_handler.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	155	155	0
tb.dut.tlul_assert_device_alert_handler.gen_host_cov.d_sinkChangedNotAccepted_C	0	0	312450685	374	374	0
tb.dut.tlul_assert_device_alert_handler.gen_host_cov.d_sizeChangedNotAccepted_C	0	0	312450685	221	221	0
tb.dut.tlul_assert_device_alert_handler.gen_host_cov.d_sourceChangedNotAccepted_C	0	0	312450685	343	343	0
tb.dut.tlul_assert_device_aon_timer_aon.gen_host_cov.b2bRsp_C	0	0	312450685	11204	11204	0
tb.dut.tlul_assert_device_aon_timer_aon.gen_host_cov.dValidNotAccepted_C	0	0	312450685	2506	2506	0
tb.dut.tlul_assert_device_aon_timer_aon.gen_host_cov.d_dataChangedNotAccepted_C	0	0	312450685	772	772	0
tb.dut.tlul_assert_device_aon_timer_aon.gen_host_cov.d_errorChangedNotAccepted_C	0	0	312450685	284	284	0
tb.dut.tlul_assert_device_aon_timer_aon.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	88	88	0
tb.dut.tlul_assert_device_aon_timer_aon.gen_host_cov.d_sinkChangedNotAccepted_C	0	0	312450685	358	358	0
tb.dut.tlul_assert_device_aon_timer_aon.gen_host_cov.d_sizeChangedNotAccepted_C	0	0	312450685	140	140	0
tb.dut.tlul_assert_device_aon_timer_aon.gen_host_cov.d_sourceChangedNotAccepted_C	0	0	312450685	207	207	0
tb.dut.tlul_assert_device_ast.gen_host_cov.b2bRsp_C	0	0	312450685	7658	7658	0
tb.dut.tlul_assert_device_ast.gen_host_cov.dValidNotAccepted_C	0	0	312450685	2304	2304	0
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tb.dut.tlul_assert_device_ast.gen_host_cov.d_errorChangedNotAccepted_C	0	0	312450685	206	206	0
tb.dut.tlul_assert_device_ast.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	39	39	0
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tb.dut.tlul_assert_device_ast.gen_host_cov.d_sizeChangedNotAccepted_C	0	0	312450685	77	77	0
tb.dut.tlul_assert_device_ast.gen_host_cov.d_sourceChangedNotAccepted_C	0	0	312450685	110	110	0
tb.dut.tlul_assert_device_clkmgr_aon.gen_host_cov.b2bRsp_C	0	0	312450685	8833	8833	0
tb.dut.tlul_assert_device_clkmgr_aon.gen_host_cov.dValidNotAccepted_C	0	0	312450685	2027	2027	0
tb.dut.tlul_assert_device_clkmgr_aon.gen_host_cov.d_dataChangedNotAccepted_C	0	0	312450685	571	571	0
tb.dut.tlul_assert_device_clkmgr_aon.gen_host_cov.d_errorChangedNotAccepted_C	0	0	312450685	213	213	0
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tb.dut.tlul_assert_device_gpio.gen_host_cov.d_dataChangedNotAccepted_C	0	0	312450685	497	497	0
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tb.dut.tlul_assert_device_gpio.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	39	39	0
tb.dut.tlul_assert_device_gpio.gen_host_cov.d_sinkChangedNotAccepted_C	0	0	312450685	254	254	0
tb.dut.tlul_assert_device_gpio.gen_host_cov.d_sizeChangedNotAccepted_C	0	0	312450685	51	51	0
tb.dut.tlul_assert_device_gpio.gen_host_cov.d_sourceChangedNotAccepted_C	0	0	312450685	76	76	0
tb.dut.tlul_assert_device_i2c0.gen_host_cov.b2bRsp_C	0	0	312450685	8161	8161	0
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tb.dut.tlul_assert_device_i2c0.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	20	20	0
tb.dut.tlul_assert_device_i2c0.gen_host_cov.d_sinkChangedNotAccepted_C	0	0	312450685	236	236	0
tb.dut.tlul_assert_device_i2c0.gen_host_cov.d_sizeChangedNotAccepted_C	0	0	312450685	34	34	0
tb.dut.tlul_assert_device_i2c0.gen_host_cov.d_sourceChangedNotAccepted_C	0	0	312450685	60	60	0
tb.dut.tlul_assert_device_i2c1.gen_host_cov.b2bRsp_C	0	0	312450685	10888	10888	0
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tb.dut.tlul_assert_device_i2c1.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	36	36	0
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tb.dut.tlul_assert_device_i2c2.gen_host_cov.b2bRsp_C	0	0	312450685	6677	6677	0
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tb.dut.tlul_assert_device_i2c2.gen_host_cov.d_errorChangedNotAccepted_C	0	0	312450685	303	303	0
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tb.dut.tlul_assert_device_i2c2.gen_host_cov.d_sinkChangedNotAccepted_C	0	0	312450685	398	398	0
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tb.dut.tlul_assert_device_i2c2.gen_host_cov.d_sourceChangedNotAccepted_C	0	0	312450685	327	327	0
tb.dut.tlul_assert_device_lc_ctrl.gen_host_cov.b2bRsp_C	0	0	312450685	9844	9844	0
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tb.dut.tlul_assert_device_lc_ctrl.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	105	105	0
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tb.dut.tlul_assert_device_lc_ctrl.gen_host_cov.d_sizeChangedNotAccepted_C	0	0	312450685	141	141	0
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tb.dut.tlul_assert_device_otp_ctrl__core.gen_host_cov.b2bRsp_C	0	0	312450685	8406	8406	0
tb.dut.tlul_assert_device_otp_ctrl__core.gen_host_cov.dValidNotAccepted_C	0	0	312450685	2061	2061	0
tb.dut.tlul_assert_device_otp_ctrl__core.gen_host_cov.d_dataChangedNotAccepted_C	0	0	312450685	640	640	0
tb.dut.tlul_assert_device_otp_ctrl__core.gen_host_cov.d_errorChangedNotAccepted_C	0	0	312450685	251	251	0
tb.dut.tlul_assert_device_otp_ctrl__core.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	83	83	0
tb.dut.tlul_assert_device_otp_ctrl__core.gen_host_cov.d_sinkChangedNotAccepted_C	0	0	312450685	298	298	0
tb.dut.tlul_assert_device_otp_ctrl__core.gen_host_cov.d_sizeChangedNotAccepted_C	0	0	312450685	97	97	0
tb.dut.tlul_assert_device_otp_ctrl__core.gen_host_cov.d_sourceChangedNotAccepted_C	0	0	312450685	160	160	0
tb.dut.tlul_assert_device_otp_ctrl__prim.gen_host_cov.b2bRsp_C	0	0	312450685	11863	11863	0
tb.dut.tlul_assert_device_otp_ctrl__prim.gen_host_cov.dValidNotAccepted_C	0	0	312450685	2305	2305	0
tb.dut.tlul_assert_device_otp_ctrl__prim.gen_host_cov.d_dataChangedNotAccepted_C	0	0	312450685	681	681	0
tb.dut.tlul_assert_device_otp_ctrl__prim.gen_host_cov.d_errorChangedNotAccepted_C	0	0	312450685	277	277	0
tb.dut.tlul_assert_device_otp_ctrl__prim.gen_host_cov.d_opcodeChangedNotAccepted_C	0	0	312450685	56	56	0
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tb.dut.tlul_assert_device_otp_ctrl__prim.gen_host_cov.d_sizeChangedNotAccepted_C	0	0	312450685	91	91	0
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Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_adc_ctrl_aon.gen_host_cov.b2bRsp_C	0	0	312450685	7853	7853	0
tb.dut.tlul_assert_device_adc_ctrl_aon.gen_host_cov.dValidNotAccepted_C	0	0	312450685	2063	2063	0
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