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tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.reqfifo.gen_passthru_fifo.paramCheckPass	0	0	600	600	0	0
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.DataKnown_A	0	0	215459342	49632423	0	0
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.DepthKnown_A	0	0	215459342	215375220	0	0
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.RvalidKnown_A	0	0	215459342	215375220	0	0
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.WreadyKnown_A	0	0	215459342	215375220	0	0
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.gen_passthru_fifo.paramCheckPass	0	0	600	600	0	0
tb.dut.u_reg.u_socket.maxN	0	0	600	600	0	0
tb.dut.u_reg.wePulse	0	0	215459342	12257559	0	0
tb.dut.u_tlul_adapter.AddrOutKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.DataIntgOptions_A	0	0	435	435	0	0
tb.dut.u_tlul_adapter.ReqOutKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.SramDwHasByteGranularity_A	0	0	435	435	0	0
tb.dut.u_tlul_adapter.SramDwIsMultipleOfTlulWidth_A	0	0	435	435	0	0
tb.dut.u_tlul_adapter.TlOutKnownIfFifoKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.TlOutValidKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.WdataOutKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.WeOutKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.WmaskOutKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.adapterNoReadOrWrite	0	0	435	435	0	0
tb.dut.u_tlul_adapter.u_err.dataWidthOnly32_A	0	0	435	435	0	0
tb.dut.u_tlul_adapter.u_reqfifo.DataKnown_A	0	0	206493108	17581161	0	0
tb.dut.u_tlul_adapter.u_reqfifo.DepthKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.u_reqfifo.RvalidKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.u_reqfifo.WreadyKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.u_reqfifo.gen_normal_fifo.depthShallNotExceedParamDepth	0	0	206493108	17581161	0	0
tb.dut.u_tlul_adapter.u_rsp_gen.DataWidthCheck_A	0	0	435	435	0	0
tb.dut.u_tlul_adapter.u_rsp_gen.PayLoadWidthCheck	0	0	435	435	0	0
tb.dut.u_tlul_adapter.u_rspfifo.DepthKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.u_rspfifo.RvalidKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.u_rspfifo.WreadyKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.u_sramreqfifo.DepthKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.u_sramreqfifo.RvalidKnown_A	0	0	206493108	206449290	0	0
tb.dut.u_tlul_adapter.u_sramreqfifo.WreadyKnown_A	0	0	206493108	206449290	0	0

Assertions Incomplete:

ASSERTIONS	CATEGORY	SEVERITY	ATTEMPTS	REAL SUCCESSES	FAILURES	INCOMPLETE	SRC
tb.dut.u_packer.DataIStable_M	0	0	206493108	562392	0	435
tb.dut.u_packer.DataOStableWhenPending_A	0	0	206493108	701781	0	435
tb.dut.u_packer.FlushFollowedByDone_A	0	0	206493108	16958	0	435

Assertions Excluded:

ASSERTIONS	CATEGORY	SEVERITY	EXCLUSION	EXCLUDE ANNOTATION	SRC
tb.dut.u_tlul_adapter.u_rspfifo.DataKnown_A	0	0	Excluded	[UNSUPPORTED] excluded by fpv
tb.dut.u_tlul_adapter.u_rspfifo.gen_normal_fifo.depthShallNotExceedParamDepth	0	0	Excluded	[UNSUPPORTED] excluded by fpv
tb.dut.u_tlul_adapter.u_sramreqfifo.DataKnown_A	0	0	Excluded	[UNSUPPORTED] excluded by fpv
tb.dut.u_tlul_adapter.u_sramreqfifo.gen_normal_fifo.depthShallNotExceedParamDepth	0	0	Excluded	[UNSUPPORTED] excluded by fpv

---

Detail Report for Cover Sequences

Cover Sequences All Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	215459709	200879	200879	0
tb.dut.tlul_assert_device.gen_device_cov.a_addressChangedNotAccepted_C	0	0	215459709	493	493	0
tb.dut.tlul_assert_device.gen_device_cov.a_dataChangedNotAccepted_C	0	0	215459709	501	501	0
tb.dut.tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	215459709	312	312	0
tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	215459709	44	44	0
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	215459709	238	238	0
tb.dut.tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	215459709	337	337	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	215459709	11254	11254	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReq_C	0	0	215459709	1998204	1998204	0
tb.dut.tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	215459709	20455091	20455091	579

Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	215459709	200879	200879	0
tb.dut.tlul_assert_device.gen_device_cov.a_addressChangedNotAccepted_C	0	0	215459709	493	493	0
tb.dut.tlul_assert_device.gen_device_cov.a_dataChangedNotAccepted_C	0	0	215459709	501	501	0
tb.dut.tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	215459709	312	312	0
tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	215459709	44	44	0
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	215459709	238	238	0
tb.dut.tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	215459709	337	337	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	215459709	11254	11254	0
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