Design Hierarchy
dashboard | hierarchy | modlist | groups | tests | asserts

NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
tb 91.29 94.84 92.25 100.00 71.79 89.38 99.49
dut 91.29 94.84 92.25 100.00 71.79 89.38 99.49
gen_alert_tx[0].u_prim_alert_sender 100.00 100.00
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reqfifo 100.00 100.00 100.00
rspfifo 100.00 100.00 100.00
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u_status_fifo_empty 100.00 100.00
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u_sramreqfifo 78.08 86.84 62.96 62.50 100.00
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0% 10% 20% 30% 40% 50% 60% 70% 80% 90% 100%