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| 0 | 0 | 436705077 | 44566141 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.addrSizeAlignedErr_A
| 0 | 0 | 436704687 | 656466 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.contigMask_M
| 0 | 0 | 436705077 | 52412884 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.dDataKnown_A
| 0 | 0 | 436705077 | 68893925 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.legalAOpcodeErr_A
| 0 | 0 | 436704687 | 437358 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.legalAParam_M
| 0 | 0 | 436705077 | 84022913 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.legalDParam_A
| 0 | 0 | 436705077 | 155746047 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.pendingReqPerSrc_M
| 0 | 0 | 436705077 | 84022913 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.respMustHaveReq_A
| 0 | 0 | 436705077 | 155746047 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.respOpcode_A
| 0 | 0 | 436705077 | 155746047 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.respSzEqReqSz_A
| 0 | 0 | 436705077 | 155746047 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.sizeGTEMaskErr_A
| 0 | 0 | 436704687 | 418870 | 0 | 0 |
|
tb.dut.tlul_assert_device.gen_device.sizeMatchesMaskErr_A
| 0 | 0 | 436704687 | 304323 | 0 | 0 |
|
tb.dut.tlul_assert_device.p_dbw.TlDbw_A
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_msg_fifo.DataKnown_A
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|
tb.dut.u_msg_fifo.DepthKnown_A
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|
tb.dut.u_msg_fifo.RvalidKnown_A
| 0 | 0 | 435626335 | 435565436 | 0 | 0 |
|
tb.dut.u_msg_fifo.WreadyKnown_A
| 0 | 0 | 435626335 | 435565436 | 0 | 0 |
|
tb.dut.u_msg_fifo.gen_normal_fifo.depthShallNotExceedParamDepth
| 0 | 0 | 435626335 | 20807980 | 0 | 0 |
|
tb.dut.u_packer.DataIStable_M
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|
tb.dut.u_packer.DataOStableWhenPending_A
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|
tb.dut.u_packer.ExFlushValid_M
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|
tb.dut.u_packer.ExcessiveDataStored_A
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|
tb.dut.u_packer.ExcessiveMaskStored_A
| 0 | 0 | 435626335 | 2 | 0 | 0 |
|
tb.dut.u_packer.FlushFollowedByDone_A
| 0 | 0 | 435626335 | 16714 | 0 | 493 |
|
tb.dut.u_packer.ValidIDeassertedOnFlush_M
| 0 | 0 | 435626335 | 26779 | 0 | 0 |
|
tb.dut.u_packer.ValidOAssertedForStoredDataGTEOutW_A
| 0 | 0 | 435626335 | 6977023 | 0 | 0 |
|
tb.dut.u_packer.ValidOPairedWidthReadyI_A
| 0 | 0 | 435626335 | 180 | 0 | 0 |
|
tb.dut.u_packer.gen_mask_assert.ContiguousOnesMask_M
| 0 | 0 | 435626335 | 9067465 | 0 | 0 |
|
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|
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|
tb.dut.u_reg.rePulse
| 0 | 0 | 436704687 | 37060240 | 0 | 0 |
|
tb.dut.u_reg.u_chk.PayLoadWidthCheck
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_reg_if.AllowedLatency_A
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_reg_if.MatchedWidthAssert
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_reg_if.u_err.dataWidthOnly32_A
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_reg_if.u_rsp_intg_gen.DataWidthCheck_A
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_reg_if.u_rsp_intg_gen.PayLoadWidthCheck
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_rsp_intg_gen.DataWidthCheck_A
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_rsp_intg_gen.PayLoadWidthCheck
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_socket.NotOverflowed_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
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tb.dut.u_reg.u_socket.fifo_h.reqfifo.DataKnown_A
| 0 | 0 | 436704687 | 84022913 | 0 | 0 |
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tb.dut.u_reg.u_socket.fifo_h.reqfifo.DepthKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.fifo_h.reqfifo.RvalidKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.fifo_h.reqfifo.WreadyKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.fifo_h.reqfifo.gen_passthru_fifo.paramCheckPass
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_socket.fifo_h.rspfifo.DataKnown_A
| 0 | 0 | 436704687 | 155746047 | 0 | 0 |
|
tb.dut.u_reg.u_socket.fifo_h.rspfifo.DepthKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.fifo_h.rspfifo.RvalidKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.fifo_h.rspfifo.WreadyKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.fifo_h.rspfifo.gen_passthru_fifo.paramCheckPass
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.reqfifo.DataKnown_A
| 0 | 0 | 436704687 | 19730561 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.reqfifo.DepthKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.reqfifo.RvalidKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.reqfifo.WreadyKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.reqfifo.gen_passthru_fifo.paramCheckPass
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.rspfifo.DataKnown_A
| 0 | 0 | 436704687 | 36135642 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.rspfifo.DepthKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.rspfifo.RvalidKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.rspfifo.WreadyKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[0].fifo_d.rspfifo.gen_passthru_fifo.paramCheckPass
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.reqfifo.DataKnown_A
| 0 | 0 | 436704687 | 62754734 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.reqfifo.DepthKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.reqfifo.RvalidKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.reqfifo.WreadyKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.reqfifo.gen_passthru_fifo.paramCheckPass
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.DataKnown_A
| 0 | 0 | 436704687 | 119610405 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.DepthKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.RvalidKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.WreadyKnown_A
| 0 | 0 | 436704687 | 436597216 | 0 | 0 |
|
tb.dut.u_reg.u_socket.gen_dfifo[1].fifo_d.rspfifo.gen_passthru_fifo.paramCheckPass
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.u_socket.maxN
| 0 | 0 | 658 | 658 | 0 | 0 |
|
tb.dut.u_reg.wePulse
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tb.dut.u_tlul_adapter.AddrOutKnown_A
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|
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|
tb.dut.u_tlul_adapter.ReqOutKnown_A
| 0 | 0 | 435626335 | 435565436 | 0 | 0 |
|
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| 0 | 0 | 493 | 493 | 0 | 0 |
|
tb.dut.u_tlul_adapter.SramDwIsMultipleOfTlulWidth_A
| 0 | 0 | 493 | 493 | 0 | 0 |
|
tb.dut.u_tlul_adapter.TlOutKnownIfFifoKnown_A
| 0 | 0 | 435626335 | 435565436 | 0 | 0 |
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tb.dut.u_tlul_adapter.TlOutValidKnown_A
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tb.dut.u_tlul_adapter.adapterNoReadOrWrite
| 0 | 0 | 493 | 493 | 0 | 0 |
|
tb.dut.u_tlul_adapter.u_err.dataWidthOnly32_A
| 0 | 0 | 493 | 493 | 0 | 0 |
|
tb.dut.u_tlul_adapter.u_reqfifo.DataKnown_A
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tb.dut.u_tlul_adapter.u_reqfifo.DepthKnown_A
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