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Assertions by Category
ASSERTPROPERTIESSEQUENCES
Total440010
Category 0440010


Assertions by Severity
ASSERTPROPERTIESSEQUENCES
Total440010
Severity 0440010


Summary for Assertions
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Total Number440100.00
Uncovered71.59
Success43398.41
Failure00.00
Incomplete10.23
Without Attempts00.00


Summary for Cover Sequences
NUMBERPERCENT
Total Number10100.00
Uncovered00.00
All Matches10100.00
First Matches10100.00


Detail Report for Assertions

Assertions Uncovered:
ASSERTIONSCATEGORYSEVERITYATTEMPTSREAL SUCCESSESFAILURESINCOMPLETESRC
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Assertions Success:
ASSERTIONSCATEGORYSEVERITYATTEMPTSREAL SUCCESSESFAILURESINCOMPLETESRC
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tb.dut.i2c_core.u_i2c_controller_fsm.SclOutputGlitch_A 00390356878540007900
tb.dut.i2c_core.u_i2c_target_fsm.AcqDepthRdCheck_A 00390356878116645200
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tb.dut.i2c_csr_assert.host_fifo_config_rd_A 00391041128568100
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tb.dut.i2c_csr_assert.host_timeout_ctrl_rd_A 00391041128191100
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tb.dut.tlul_assert_device.gen_assert_final[0].noOutstandingReqsAtEndOfSim_A 001641164100
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Assertions Incomplete:
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Detail Report for Cover Sequences

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Cover Sequences First Matches:
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