Design Hierarchy
dashboard | hierarchy | modlist | groups | tests | asserts

NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
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dut 91.40 97.15 89.46 97.22 72.02 94.11 98.44
gen_alert_tx[0].u_prim_alert_sender 100.00 100.00
i2c_core 87.57 96.10 83.75 72.02 91.30 94.69
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u_oup_buf 97.16 100.00 88.64 100.00 100.00
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gen_normal_fifo.u_fifo_cnt 100.00 100.00 100.00 100.00
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u_inp_buf 94.32 100.00 81.82 95.45 100.00
gen_normal_fifo.u_fifo_cnt 94.10 100.00 90.00 92.31
u_oup_buf 97.16 100.00 88.64 100.00 100.00
gen_normal_fifo.u_fifo_cnt 100.00 100.00 100.00 100.00
u_sram_ptrs 100.00 100.00 100.00 100.00
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gen_generic.u_impl_generic 100.00 100.00 100.00
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subtree...
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