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Detail Report for Assertions

Assertions Uncovered:

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Assertions Success:

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tb.dut.i2c_core.u_i2c_target_fsm.SclOutputGlitch_A	0	0	377484049	60674	0	0
tb.dut.i2c_csr_assert.ctrl_rd_A	0	0	378295274	2537	0	0
tb.dut.i2c_csr_assert.host_fifo_config_rd_A	0	0	378295274	4684	0	0
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Assertions Incomplete:

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Detail Report for Cover Sequences

Cover Sequences All Matches:

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Cover Sequences First Matches:

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