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Detail Report for Assertions

Assertions Uncovered:

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Assertions Success:

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tb.dut.u_tl_adapter_rom.u_sramreqfifo.gen_normal_fifo.depthShallNotExceedParamDepth	0	0	30855431	32454	0	0

Assertions Incomplete:

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tb.dut.gen_fsm_scramble_enabled.u_checker_fsm.SecCmCFILinear_A	0	0	30855431	5079	0	1244

---

Detail Report for Cover Sequences

Cover Sequences Uncovered:

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Cover Sequences All Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.regs_tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	33841642	233	233	0
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tb.dut.regs_tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	33841642	7	7	0
tb.dut.regs_tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	33841642	16	16	0
tb.dut.regs_tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	33841642	5	5	0
tb.dut.regs_tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	33841642	14	14	0
tb.dut.regs_tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	33841642	1316	1316	0
tb.dut.regs_tlul_assert_device.gen_device_cov.b2bReq_C	0	0	33841642	2543	2543	0
tb.dut.regs_tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	33841642	3434	3434	145
tb.dut.rom_tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	33841642	47238	47238	0
tb.dut.rom_tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	33841642	1	1	0
tb.dut.rom_tlul_assert_device.gen_device_cov.b2bReq_C	0	0	33841642	13172	13172	0
tb.dut.rom_tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	33841642	285	285	90

Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.regs_tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	33841642	233	233	0
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