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Detail Report for Assertions

Assertions Uncovered:

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Assertions Success:

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tb.dut.u_tl_adapter_rom.u_sramreqfifo.gen_normal_fifo.depthShallNotExceedParamDepth	0	0	28312121	31269	0	0

Assertions Incomplete:

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tb.dut.gen_fsm_scramble_enabled.u_checker_fsm.SecCmCFILinear_A	0	0	28312121	5189	0	1246

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Detail Report for Cover Sequences

Cover Sequences Uncovered:

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Cover Sequences All Matches:

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tb.dut.regs_tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	31884514	26	26	0
tb.dut.regs_tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	31884514	51	51	0
tb.dut.regs_tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	31884514	19	19	0
tb.dut.regs_tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	31884514	25	25	0
tb.dut.regs_tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	31884514	1200	1200	0
tb.dut.regs_tlul_assert_device.gen_device_cov.b2bReq_C	0	0	31884514	2172	2172	0
tb.dut.regs_tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	31884514	2475	2475	146
tb.dut.rom_tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	31884514	56662	56662	0
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tb.dut.rom_tlul_assert_device.gen_device_cov.b2bReq_C	0	0	31884514	12211	12211	0
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Cover Sequences First Matches:

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