Module Definition
dashboard | hierarchy | modlist | groups | tests | asserts

Module : kmac
SCORELINECONDTOGGLEFSMBRANCHASSERT
98.28 98.28

Source File(s) :
/workspace/default/sim-vcs/../src/lowrisc_ip_kmac_0.1/rtl/kmac.sv

Module self-instances :
NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
tb.dut.top_earlgrey.u_kmac 99.29 99.29



Module Instance : tb.dut.top_earlgrey.u_kmac

Instance :
SCORELINECONDTOGGLEFSMBRANCHASSERT
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Instance's subtree :
SCORELINECONDTOGGLEFSMBRANCHASSERT
99.29 99.29


Parent :
SCORELINECONDTOGGLEFSMBRANCHASSERTNAME
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Subtrees :
NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
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Toggle Coverage for Module : kmac
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Ports 76 61 80.26
Port Bits 6506 6394 98.28
Port Bits 0->1 3253 3198 98.31
Port Bits 1->0 3253 3196 98.25

Port Details
NameToggleToggle 1->0TestsToggle 0->1TestsDirection
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tl_i.a_param[2:0] Unreachable Unreachable Unreachable INPUT
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tl_o.a_ready Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_error No No No OUTPUT
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tl_o.d_user.rsp_intg[1:0] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_user.rsp_intg[3:2] No No No OUTPUT
tl_o.d_user.rsp_intg[5:4] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_user.rsp_intg[6] No No No OUTPUT
tl_o.d_data[31:0] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
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tl_o.d_source[1:0] Yes Yes *T139,*T136,*T137 Yes T139,T136,T137 OUTPUT
tl_o.d_source[5:2] No No No OUTPUT
tl_o.d_source[7:6] Unreachable Unreachable Unreachable OUTPUT
tl_o.d_size[0] No No No OUTPUT
tl_o.d_size[1] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_param[2:0] Unreachable Unreachable Unreachable OUTPUT
tl_o.d_opcode[0] Yes Yes *T136,*T137,*T138 Yes T136,T137,T138 OUTPUT
tl_o.d_opcode[2:1] Unreachable Unreachable Unreachable OUTPUT
tl_o.d_valid Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
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keymgr_key_i.key[1][216] Yes Yes T59,T137,T138 Yes T59,T137,T138 INPUT
keymgr_key_i.key[1][217] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[1][218] Yes Yes T137,T138,T134 Yes T137,T138,T134 INPUT
keymgr_key_i.key[1][220:219] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
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keymgr_key_i.key[1][223] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[1][224] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[1][225] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[1][226] Yes Yes T137,T138,T134 Yes T137,T138,T134 INPUT
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keymgr_key_i.key[1][228] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[1][229] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[1][230] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[1][231] Yes Yes T136,T59,T134 Yes T136,T59,T134 INPUT
keymgr_key_i.key[1][233:232] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[1][234] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
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keymgr_key_i.key[1][238:237] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
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keymgr_key_i.key[1][246] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
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keymgr_key_i.key[1][253] Yes Yes T137,T138,T134 Yes T137,T138,T134 INPUT
keymgr_key_i.key[1][254] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[1][255] Yes Yes T59,T137,T138 Yes T59,T137,T138 INPUT
keymgr_key_i.valid Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
app_i[0].last Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
app_i[0].strb[7:0] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
app_i[0].data[63:0] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
app_i[0].valid Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
app_i[1].last Yes Yes T60,T78,T158 Yes T60,T78,T158 INPUT
app_i[1].strb[7:0] Yes Yes T60,T78,T158 Yes T60,T78,T158 INPUT
app_i[1].data[63:0] Yes Yes T60,T78,T105 Yes T60,T78,T105 INPUT
app_i[1].valid Yes Yes T60,T78,T158 Yes T60,T78,T158 INPUT
app_i[2].last Yes Yes T4,T5,T6 Yes T4,T5,T6 INPUT
app_i[2].strb[7:0] No No No INPUT
app_i[2].data[38:0] Yes Yes T4,T5,T6 Yes T4,T5,T6 INPUT
app_i[2].data[63:39] No No No INPUT
app_i[2].valid Yes Yes T4,T5,T6 Yes T4,T5,T6 INPUT
app_o[0].error Yes Yes T5,T17,T114 Yes T5,T17,T114 OUTPUT
app_o[0].digest_share1[383:0] Yes Yes T137,T138,T134 Yes T137,T138,T134 OUTPUT
app_o[0].digest_share0[383:0] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
app_o[0].done Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
app_o[0].ready Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
app_o[1].error No No No OUTPUT
app_o[1].digest_share1[383:0] Yes Yes T60,T78,T158 Yes T60,T78,T158 OUTPUT
app_o[1].digest_share0[383:0] Yes Yes T230,T231,T209 Yes T230,T231,T209 OUTPUT
app_o[1].done Yes Yes T60,T78,T158 Yes T60,T78,T158 OUTPUT
app_o[1].ready Yes Yes T60,T78,T158 Yes T60,T78,T158 OUTPUT
app_o[2].error No No Yes T158,T214,T215 OUTPUT
app_o[2].digest_share1[383:0] Yes Yes T4,T5,T6 Yes T4,T5,T6 OUTPUT
app_o[2].digest_share0[383:0] Yes Yes T57,T20,T58 Yes T57,T20,T58 OUTPUT
app_o[2].done Yes Yes T4,T5,T6 Yes T4,T5,T6 OUTPUT
app_o[2].ready Yes Yes T4,T5,T6 Yes T4,T5,T6 OUTPUT
entropy_o.edn_req Yes Yes T143,T75,T407 Yes T143,T75,T407 OUTPUT
entropy_i.edn_bus[31:0] Yes Yes T143,T75,T407 Yes T143,T75,T407 INPUT
entropy_i.edn_fips No No Yes T143,T75,T407 INPUT
entropy_i.edn_ack Yes Yes T143,T75,T407 Yes T143,T75,T407 INPUT
lc_escalate_en_i[3:0] Yes Yes T5,T17,T114 Yes T5,T17,T114 INPUT
intr_kmac_done_o Yes Yes T111,T112,T113 Yes T111,T112,T113 OUTPUT
intr_fifo_empty_o Yes Yes T111,T112,T113 Yes T111,T112,T113 OUTPUT
intr_kmac_err_o Yes Yes T111,T112,T113 Yes T111,T112,T113 OUTPUT
en_masking_o Unreachable Unreachable Unreachable OUTPUT
idle_o[3:0] Yes Yes T4,T5,T6 Yes T4,T5,T6 OUTPUT

*Tests covering at least one bit in the range
Toggle Coverage for Instance : tb.dut.top_earlgrey.u_kmac
TotalCoveredPercent
Totals 75 62 82.67
Total Bits 6440 6394 99.29
Total Bits 0->1 3220 3198 99.32
Total Bits 1->0 3220 3196 99.25

Ports 75 62 82.67
Port Bits 6440 6394 99.29
Port Bits 0->1 3220 3198 99.32
Port Bits 1->0 3220 3196 99.25

Port Details
NameToggleToggle 1->0TestsToggle 0->1TestsDirectionExclude Annotation
clk_i Yes Yes T4,T5,T6 Yes T4,T5,T6 INPUT
rst_ni Yes Yes T5,T17,T19 Yes T4,T5,T6 INPUT
rst_shadowed_ni Yes Yes T5,T17,T19 Yes T4,T5,T6 INPUT
clk_edn_i Yes Yes T4,T5,T6 Yes T4,T5,T6 INPUT
rst_edn_ni Yes Yes T5,T17,T19 Yes T4,T5,T6 INPUT
tl_i.d_ready Yes Yes T5,T17,T19 Yes T4,T5,T6 INPUT
tl_i.a_user.data_intg[6:0] Yes Yes T134,T74,T135 Yes T134,T74,T135 INPUT
tl_i.a_user.cmd_intg[6:0] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
tl_i.a_user.instr_type[0] Yes Yes *T136,*T137,*T138 Yes T136,T137,T138 INPUT
tl_i.a_user.instr_type[2:1] No No No INPUT
tl_i.a_user.instr_type[3] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
tl_i.a_user.rsvd[4:0] Unreachable Unreachable Unreachable INPUT
tl_i.a_data[31:0] Yes Yes T134,T74,T135 Yes T134,T74,T135 INPUT
tl_i.a_mask[3:0] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
tl_i.a_address[1:0] No No No INPUT
tl_i.a_address[8:2] Yes Yes *T136,*T137,*T138 Yes T136,T137,T138 INPUT
tl_i.a_address[9] No No No INPUT
tl_i.a_address[11:10] Yes Yes T74,T140,T141 Yes T74,T140,T141 INPUT
tl_i.a_address[16:12] Unreachable Unreachable Unreachable INPUT
tl_i.a_address[17] Yes Yes *T136,*T137,*T138 Yes T136,T137,T138 INPUT
tl_i.a_address[19:18] Unreachable Unreachable Unreachable INPUT
tl_i.a_address[20] Yes Yes *T136,*T137,*T138 Yes T136,T137,T138 INPUT
tl_i.a_address[23:21] Unreachable Unreachable Unreachable INPUT
tl_i.a_address[24] Yes Yes *T136,*T137,*T138 Yes T136,T137,T138 INPUT
tl_i.a_address[29:25] Unreachable Unreachable Unreachable INPUT
tl_i.a_address[30] Yes Yes *T136,*T137,*T138 Yes T136,T137,T138 INPUT
tl_i.a_address[31] Unreachable Unreachable Unreachable INPUT
tl_i.a_source[1:0] Yes Yes *T139,*T136,*T137 Yes T139,T136,T137 INPUT
tl_i.a_source[5:2] No No No INPUT
tl_i.a_source[7:6] Unreachable Unreachable Unreachable INPUT
tl_i.a_size[0] No No No INPUT
tl_i.a_size[1] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
tl_i.a_param[2:0] Unreachable Unreachable Unreachable INPUT
tl_i.a_opcode[0] Yes Yes *T74,*T140,*T141 Yes T74,T140,T141 INPUT
tl_i.a_opcode[1] No No No INPUT
tl_i.a_opcode[2] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
tl_i.a_valid Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
tl_o.a_ready Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_error No No No OUTPUT
tl_o.d_user.data_intg[6:0] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_user.rsp_intg[1:0] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_user.rsp_intg[3:2] No No No OUTPUT
tl_o.d_user.rsp_intg[5:4] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_user.rsp_intg[6] No No No OUTPUT
tl_o.d_data[31:0] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_sink No No No OUTPUT
tl_o.d_source[1:0] Yes Yes *T139,*T136,*T137 Yes T139,T136,T137 OUTPUT
tl_o.d_source[5:2] No No No OUTPUT
tl_o.d_source[7:6] Unreachable Unreachable Unreachable OUTPUT
tl_o.d_size[0] No No No OUTPUT
tl_o.d_size[1] Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
tl_o.d_param[2:0] Unreachable Unreachable Unreachable OUTPUT
tl_o.d_opcode[0] Yes Yes *T136,*T137,*T138 Yes T136,T137,T138 OUTPUT
tl_o.d_opcode[2:1] Unreachable Unreachable Unreachable OUTPUT
tl_o.d_valid Yes Yes T136,T137,T138 Yes T136,T137,T138 OUTPUT
alert_rx_i[0].ack_n Yes Yes T4,T5,T6 Yes T4,T5,T6 INPUT
alert_rx_i[0].ack_p Yes Yes T189,T110,T184 Yes T189,T110,T184 INPUT
alert_rx_i[0].ping_n Yes Yes T189,T110,T184 Yes T189,T110,T184 INPUT
alert_rx_i[0].ping_p Yes Yes T189,T110,T184 Yes T189,T110,T184 INPUT
alert_rx_i[1].ack_n Yes Yes T4,T5,T6 Yes T4,T5,T6 INPUT
alert_rx_i[1].ack_p Yes Yes T5,T17,T114 Yes T5,T17,T114 INPUT
alert_rx_i[1].ping_n Yes Yes T189,T110,T163 Yes T189,T110,T163 INPUT
alert_rx_i[1].ping_p Yes Yes T189,T110,T163 Yes T189,T110,T163 INPUT
alert_tx_o[0].alert_n Yes Yes T4,T5,T6 Yes T4,T5,T6 OUTPUT
alert_tx_o[0].alert_p Yes Yes T189,T110,T184 Yes T189,T110,T184 OUTPUT
alert_tx_o[1].alert_n Yes Yes T4,T5,T6 Yes T4,T5,T6 OUTPUT
alert_tx_o[1].alert_p Yes Yes T5,T17,T114 Yes T5,T17,T114 OUTPUT
keymgr_key_i.key[0][0] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[0][1] Yes Yes T59,T137,T134 Yes T59,T137,T134 INPUT
keymgr_key_i.key[0][2] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[0][3] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[0][4] Yes Yes T136,T138,T134 Yes T136,T138,T134 INPUT
keymgr_key_i.key[0][5] Yes Yes T136,T137,T134 Yes T136,T137,T134 INPUT
keymgr_key_i.key[0][6] Yes Yes T137,T134,T135 Yes T137,T134,T135 INPUT
keymgr_key_i.key[0][7] Yes Yes T136,T138,T134 Yes T136,T138,T134 INPUT
keymgr_key_i.key[0][8] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[0][9] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[0][10] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[0][11] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[0][12] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[0][13] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[0][14] Yes Yes T136,T137,T134 Yes T136,T137,T134 INPUT
keymgr_key_i.key[0][15] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[0][16] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[0][17] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
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keymgr_key_i.key[0][26] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[0][27] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[0][28] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[0][29] Yes Yes T136,T59,T138 Yes T136,T59,T138 INPUT
keymgr_key_i.key[0][30] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
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keymgr_key_i.key[0][46] Yes Yes T136,T137,T138 Yes T136,T137,T138 INPUT
keymgr_key_i.key[0][47] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
keymgr_key_i.key[0][48] Yes Yes T136,T59,T137 Yes T136,T59,T137 INPUT
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