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Detail Report for Assertions

Assertions Success:

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tb.dut.tlul_assert_device.gen_device.addrSizeAlignedErr_A	0	0	525440842	4460	0	0
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tb.dut.tlul_assert_device.gen_device.dDataKnown_A	0	0	525441831	82159648	0	0
tb.dut.tlul_assert_device.gen_device.legalAOpcodeErr_A	0	0	525440842	4940	0	0
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tb.dut.tlul_assert_device.gen_device.legalDParam_A	0	0	525441831	95445419	0	0
tb.dut.tlul_assert_device.gen_device.pendingReqPerSrc_M	0	0	525441831	85647030	0	0
tb.dut.tlul_assert_device.gen_device.respMustHaveReq_A	0	0	525441831	95445419	0	0
tb.dut.tlul_assert_device.gen_device.respOpcode_A	0	0	525441831	95445419	0	0
tb.dut.tlul_assert_device.gen_device.respSzEqReqSz_A	0	0	525441831	95445419	0	0
tb.dut.tlul_assert_device.gen_device.sizeGTEMaskErr_A	0	0	525440842	2846	0	0
tb.dut.tlul_assert_device.gen_device.sizeMatchesMaskErr_A	0	0	525440842	2157	0	0
tb.dut.tlul_assert_device.p_dbw.TlDbw_A	0	0	1627	1627	0	0
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tb.dut.u_reg.u_reg_if.u_err.dataWidthOnly32_A	0	0	1627	1627	0	0
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Detail Report for Cover Sequences

Cover Sequences All Matches:

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tb.dut.tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	525441831	1240570	1240570	0
tb.dut.tlul_assert_device.gen_device_cov.a_addressChangedNotAccepted_C	0	0	525441831	153	153	0
tb.dut.tlul_assert_device.gen_device_cov.a_dataChangedNotAccepted_C	0	0	525441831	162	162	0
tb.dut.tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	525441831	98	98	0
tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	525441831	20	20	0
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	525441831	78	78	0
tb.dut.tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	525441831	121	121	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	525441831	1888	1888	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReq_C	0	0	525441831	15796725	15796725	0
tb.dut.tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	525441831	19836326	19836326	1607

Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	525441831	1240570	1240570	0
tb.dut.tlul_assert_device.gen_device_cov.a_addressChangedNotAccepted_C	0	0	525441831	153	153	0
tb.dut.tlul_assert_device.gen_device_cov.a_dataChangedNotAccepted_C	0	0	525441831	162	162	0
tb.dut.tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	525441831	98	98	0
tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	525441831	20	20	0
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	525441831	78	78	0
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