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Detail Report for Assertions

Assertions Uncovered:

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Assertions Success:

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tb.dut.i2c_csr_assert.ctrl_rd_A	0	0	413317120	1115	0	0
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Assertions Incomplete:

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Detail Report for Cover Sequences

Cover Sequences All Matches:

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Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	413318092	212261	212261	0
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