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Assertions Uncovered:

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Assertions Success:

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Detail Report for Cover Sequences

Cover Sequences All Matches:

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Cover Sequences First Matches:

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tb.dut.tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	581319	950	950	0
tb.dut.tlul_assert_device.gen_device_cov.a_addressChangedNotAccepted_C	0	0	581319	165	165	0
tb.dut.tlul_assert_device.gen_device_cov.a_dataChangedNotAccepted_C	0	0	581319	170	170	0
tb.dut.tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	581319	118	118	0
tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	581319	21	21	0
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	581319	96	96	0
tb.dut.tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	581319	75	75	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	581319	4777	4777	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReq_C	0	0	581319	6571	6571	0
tb.dut.tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	581319	14303	14303	140