Design Hierarchy
dashboard | hierarchy | modlist | groups | tests | asserts

NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
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dut 90.92 96.60 90.03 97.22 69.64 93.62 98.44
gen_alert_tx[0].u_prim_alert_sender 100.00 100.00
i2c_core 86.95 95.15 84.86 69.64 90.41 94.69
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u_oup_buf 97.16 100.00 88.64 100.00 100.00
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gen_normal_fifo.u_fifo_cnt 94.10 100.00 90.00 92.31
u_oup_buf 97.73 100.00 90.91 100.00 100.00
gen_normal_fifo.u_fifo_cnt 100.00 100.00 100.00 100.00
u_sram_ptrs 100.00 100.00 100.00 100.00
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u_inp_buf 94.32 100.00 81.82 95.45 100.00
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u_oup_buf 97.16 100.00 88.64 100.00 100.00
gen_normal_fifo.u_fifo_cnt 100.00 100.00 100.00 100.00
u_sram_ptrs 100.00 100.00 100.00 100.00
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u_inp_buf 94.32 100.00 81.82 95.45 100.00
gen_normal_fifo.u_fifo_cnt 94.10 100.00 90.00 92.31
u_oup_buf 97.16 100.00 88.64 100.00 100.00
gen_normal_fifo.u_fifo_cnt 100.00 100.00 100.00 100.00
u_sram_ptrs 100.00 100.00 100.00 100.00
u_i2c_bus_monitor 89.23 96.26 89.25 81.82 89.58
u_i2c_controller_fsm 85.39 91.49 79.93 68.63 86.89 100.00
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u_sync_1 100.00 100.00 100.00
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u_sync_2 100.00 100.00 100.00
gen_generic.u_impl_generic 100.00 100.00 100.00
u_i2c_target_fsm 81.11 86.76 74.17 68.87 75.76 100.00
i2c_csr_assert 93.75 93.75
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u_reg 98.63 98.59 96.99 100.00 97.58 100.00
subtree...
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