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Assertions Success:

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Detail Report for Cover Sequences

Cover Sequences All Matches:

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tb.dut.tlul_assert_device.gen_device_cov.a_addressChangedNotAccepted_C	0	0	2212711	58	58	1
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tb.dut.tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	2212711	19	19	1
tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	2212711	28	28	1
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	2212711	16	16	1
tb.dut.tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	2212711	18	18	1
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tb.dut.tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	2212711	2468	2468	64

Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	2212711	531	531	0
tb.dut.tlul_assert_device.gen_device_cov.a_addressChangedNotAccepted_C	0	0	2212711	58	58	1
tb.dut.tlul_assert_device.gen_device_cov.a_dataChangedNotAccepted_C	0	0	2212711	60	60	1
tb.dut.tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	2212711	19	19	1
tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	2212711	28	28	1
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	2212711	16	16	1
tb.dut.tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	2212711	18	18	1
tb.dut.tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	2212711	4663	4663	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReq_C	0	0	2212711	6075	6075	0
tb.dut.tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	2212711	2468	2468	64