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Detail Report for Assertions

Assertions Uncovered:

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Assertions Success:

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Assertions Incomplete:

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Detail Report for Cover Sequences

Cover Sequences Uncovered:

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Cover Sequences All Matches:

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tb.dut.regs_tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	32491221	1350	1350	0
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tb.dut.rom_tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	32491221	44231	44231	0
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tb.dut.rom_tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	32491221	317	317	89

Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
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