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tb.dut.u_tlul_lc_gate.u_err_en_sync.NumCopiesMustBeGreaterZero_A	0	0	905	905	0	0
tb.dut.u_tlul_lc_gate.u_err_en_sync.OutputsKnown_A	0	0	706276940	706161530	0	0
tb.dut.u_tlul_lc_gate.u_err_en_sync.gen_no_flops.OutputDelay_A	0	0	706276940	706161530	0	0
tb.dut.u_tlul_lc_gate.u_state_regs.AssertConnected_A	0	0	905	905	0	0
tb.dut.u_tlul_lc_gate.u_state_regs_A	0	0	706276940	706161530	0	0
tb.dut.u_tlul_lc_gate.u_tlul_err_resp.u_intg_gen.DataWidthCheck_A	0	0	905	905	0	0
tb.dut.u_tlul_lc_gate.u_tlul_err_resp.u_intg_gen.PayLoadWidthCheck	0	0	905	905	0	0

Assertions Incomplete:

ASSERTIONS	CATEGORY	SEVERITY	ATTEMPTS	REAL SUCCESSES	FAILURES	INCOMPLETE	SRC
tb.dut.u_prim_lc_sync.gen_flops.OutputDelay_A	0	0	706276940	706151965	0	2715

---

Detail Report for Cover Sequences

Cover Sequences All Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_ram.gen_device_cov.aValidNotAccepted_C	0	0	707139925	3298235	3298235	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_addressChangedNotAccepted_C	0	0	707139925	122150	122150	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_dataChangedNotAccepted_C	0	0	707139925	121750	121750	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_maskChangedNotAccepted_C	0	0	707139925	22050	22050	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	707139925	78250	78250	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	707139925	11850	11850	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	707139925	400	400	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReqWithSameAddr_C	0	0	707139925	13932850	13932850	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReq_C	0	0	707139925	21906895	21906895	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bSameSource_C	0	0	707139925	41700550	41700550	700
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C	0	0	707139925	230	230	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C	0	0	707139925	60	60	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C	0	0	707139925	80	80	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C	0	0	707139925	60	60	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	707139925	40	40	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	707139925	60	60	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	707139925	40	40	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C	0	0	707139925	80	80	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C	0	0	707139925	440	440	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C	0	0	707139925	1065550	1065550	825

Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_ram.gen_device_cov.aValidNotAccepted_C	0	0	707139925	3298235	3298235	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_addressChangedNotAccepted_C	0	0	707139925	122150	122150	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_dataChangedNotAccepted_C	0	0	707139925	121750	121750	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_maskChangedNotAccepted_C	0	0	707139925	22050	22050	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	707139925	78250	78250	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	707139925	11850	11850	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	707139925	400	400	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReqWithSameAddr_C	0	0	707139925	13932850	13932850	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReq_C	0	0	707139925	21906895	21906895	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bSameSource_C	0	0	707139925	41700550	41700550	700
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C	0	0	707139925	230	230	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C	0	0	707139925	60	60	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C	0	0	707139925	80	80	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C	0	0	707139925	60	60	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	707139925	40	40	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	707139925	60	60	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	707139925	40	40	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C	0	0	707139925	80	80	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C	0	0	707139925	440	440	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C	0	0	707139925	1065550	1065550	825