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tb.dut.u_tlul_lc_gate.u_err_en_sync.NumCopiesMustBeGreaterZero_A	0	0	886	886	0	0
tb.dut.u_tlul_lc_gate.u_err_en_sync.OutputsKnown_A	0	0	304601967	304474429	0	0
tb.dut.u_tlul_lc_gate.u_err_en_sync.gen_no_flops.OutputDelay_A	0	0	304601967	304474429	0	0
tb.dut.u_tlul_lc_gate.u_state_regs.AssertConnected_A	0	0	886	886	0	0
tb.dut.u_tlul_lc_gate.u_state_regs_A	0	0	304601967	304474429	0	0
tb.dut.u_tlul_lc_gate.u_tlul_err_resp.u_intg_gen.DataWidthCheck_A	0	0	886	886	0	0
tb.dut.u_tlul_lc_gate.u_tlul_err_resp.u_intg_gen.PayLoadWidthCheck	0	0	886	886	0	0

Assertions Incomplete:

ASSERTIONS	CATEGORY	SEVERITY	ATTEMPTS	REAL SUCCESSES	FAILURES	INCOMPLETE	SRC
tb.dut.u_prim_lc_sync.gen_flops.OutputDelay_A	0	0	304601967	304463389	0	2658

---

Detail Report for Cover Sequences

Cover Sequences All Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_ram.gen_device_cov.aValidNotAccepted_C	0	0	305806579	528194	528194	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_addressChangedNotAccepted_C	0	0	305806579	113122	113122	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_dataChangedNotAccepted_C	0	0	305806579	112705	112705	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_maskChangedNotAccepted_C	0	0	305806579	21198	21198	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	305806579	70669	70669	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	305806579	10995	10995	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	305806579	48605	48605	4
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReqWithSameAddr_C	0	0	305806579	11882010	11882010	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReq_C	0	0	305806579	26895871	26895871	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bSameSource_C	0	0	305806579	16147562	16147562	677
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C	0	0	305806579	327	327	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C	0	0	305806579	72	72	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C	0	0	305806579	92	92	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C	0	0	305806579	53	53	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	305806579	23	23	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	305806579	55	55	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	305806579	43	43	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C	0	0	305806579	1544	1544	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C	0	0	305806579	3022	3022	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C	0	0	305806579	1231428	1231428	805

Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_ram.gen_device_cov.aValidNotAccepted_C	0	0	305806579	528194	528194	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_addressChangedNotAccepted_C	0	0	305806579	113122	113122	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_dataChangedNotAccepted_C	0	0	305806579	112705	112705	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_maskChangedNotAccepted_C	0	0	305806579	21198	21198	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	305806579	70669	70669	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	305806579	10995	10995	4
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	305806579	48605	48605	4
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReqWithSameAddr_C	0	0	305806579	11882010	11882010	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReq_C	0	0	305806579	26895871	26895871	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bSameSource_C	0	0	305806579	16147562	16147562	677
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C	0	0	305806579	327	327	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C	0	0	305806579	72	72	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C	0	0	305806579	92	92	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C	0	0	305806579	53	53	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	305806579	23	23	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	305806579	55	55	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	305806579	43	43	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C	0	0	305806579	1544	1544	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C	0	0	305806579	3022	3022	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C	0	0	305806579	1231428	1231428	805