Unified Coverage Report :: Group Instance : tl_agent_pkg.uvm_test_top.env.alert_handler_agent.cov::m_max_outstanding_cg

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

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values[79]	86	1			T530	6		T492	1		T799	1
values[80]	73	1			T530	4		T492	1		T799	1
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values[87]	82	1			T530	4		T492	1		T799	1
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Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	159229	1			T98	10		T99	8		T100	68
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values[106]	49	1			T562	1		T508	4		T802	1
values[107]	49	1			T562	3		T508	5		T802	1
values[108]	51	1			T562	2		T508	6		T802	3
values[109]	50	1			T562	4		T508	4		T802	2
values[110]	60	1			T562	1		T508	5		T802	5
values[111]	67	1			T562	3		T508	3		T802	5
values[112]	59	1			T562	2		T508	3		T802	5
values[113]	54	1			T562	3		T508	6		T802	1
values[114]	58	1			T562	3		T508	3		T802	1
values[115]	50	1			T562	2		T508	3		T802	3
values[116]	68	1			T562	4		T508	2		T802	4
values[117]	67	1			T562	4		T508	10		T802	3
values[118]	65	1			T562	3		T508	4		T802	4
values[119]	58	1			T562	3		T508	3		T802	3
values[120]	83	1			T562	2		T508	3		T802	7
values[121]	64	1			T562	5		T508	4		T802	5
values[122]	73	1			T562	7		T508	7		T802	3
values[123]	91	1			T562	12		T508	2		T802	6
values[124]	123	1			T562	19		T508	2		T802	1
values[125]	269	1			T562	44		T508	5		T802	3
values[126]	572	1			T562	75		T508	27		T802	8
values[127]	2017	1			T562	40		T508	215		T802	78
values[128]	3607	1			T562	3		T508	427		T802	182

Summary for Variable cp_num_of_outstanding

CATEGORY	EXPECTED	UNCOVERED	COVERED	PERCENT
User Defined Bins	128	0	128	100.00

User Defined Bins for cp_num_of_outstanding

Bins

NAME	COUNT	AT LEAST	STATUS		TEST	COUNT		TEST	COUNT		TEST	COUNT
values[1]	132070	1			T98	8		T99	5		T100	63
values[2]	7439	1			T100	2		T477	2		T559	1
values[3]	2904	1			T562	57		T803	12		T653	85
values[4]	1809	1			T562	52		T803	10		T653	40
values[5]	1272	1			T562	40		T803	2		T653	32
values[6]	946	1			T562	49		T803	9		T653	20
values[7]	757	1			T562	20		T803	5		T653	2
values[8]	613	1			T562	17		T803	7		T653	17
values[9]	528	1			T562	21		T803	11		T653	8
values[10]	459	1			T562	9		T803	3		T653	11
values[11]	392	1			T562	7		T803	4		T653	1
values[12]	322	1			T562	9		T803	12		T596	9
values[13]	311	1			T803	7		T596	12		T507	7
values[14]	283	1			T803	7		T596	4		T507	13
values[15]	338	1			T803	10		T596	3		T507	3
values[16]	320	1			T803	5		T596	3		T507	2
values[17]	335	1			T803	10		T596	3		T507	5
values[18]	308	1			T803	10		T596	2		T507	13
values[19]	300	1			T803	6		T596	9		T507	9
values[20]	297	1			T803	6		T596	6		T507	12
values[21]	292	1			T803	3		T596	4		T507	4
values[22]	302	1			T803	21		T596	8		T507	4
values[23]	270	1			T803	11		T596	4		T507	5
values[24]	315	1			T803	9		T596	13		T507	6
values[25]	258	1			T803	3		T596	15		T507	4
values[26]	312	1			T803	4		T596	7		T507	5
values[27]	312	1			T803	10		T596	4		T507	7
values[28]	287	1			T803	5		T596	9		T507	3
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values[33]	305	1			T803	6		T596	7		T507	5
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values[35]	308	1			T803	23		T596	13		T507	18
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values[53]	195	1			T596	10		T507	3		T804	4
values[54]	269	1			T596	18		T804	4		T661	23
values[55]	217	1			T596	11		T804	4		T661	4
values[56]	229	1			T596	14		T804	4		T661	7
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