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Assertions by Category
ASSERTPROPERTIESSEQUENCES
Total432010
Category 0432010


Assertions by Severity
ASSERTPROPERTIESSEQUENCES
Total432010
Severity 0432010


Summary for Assertions
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Total Number432100.00
Uncovered10.23
Success43199.77
Failure00.00
Incomplete235.32
Without Attempts00.00


Summary for Cover Sequences
NUMBERPERCENT
Total Number10100.00
Uncovered00.00
All Matches10100.00
First Matches10100.00


Detail Report for Assertions

Assertions Uncovered:
ASSERTIONSCATEGORYSEVERITYATTEMPTSREAL SUCCESSESFAILURESINCOMPLETESRC
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Assertions Success:
ASSERTIONSCATEGORYSEVERITYATTEMPTSREAL SUCCESSESFAILURESINCOMPLETESRC
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tb.dut.u_edn_core.gen_ep_blk[4].u_prim_packer_fifo_ep.DataOStableWhenPending_A 00100840051691850946
tb.dut.u_edn_core.gen_ep_blk[4].u_prim_packer_fifo_ep.ValidOPairedWithReadyI_A 001008400516918500
tb.dut.u_edn_core.gen_ep_blk[5].u_edn_ack_sm_ep.AckSmErrorStStable_A 001008400516312100
tb.dut.u_edn_core.gen_ep_blk[5].u_edn_ack_sm_ep.FpvSecCmErrorStEscalate_A 001008400516416200
tb.dut.u_edn_core.gen_ep_blk[5].u_edn_ack_sm_ep.u_state_regs.AssertConnected_A 0094694600
tb.dut.u_edn_core.gen_ep_blk[5].u_edn_ack_sm_ep.u_state_regs_A 0010084005990720900
tb.dut.u_edn_core.gen_ep_blk[5].u_prim_packer_fifo_ep.DataOStableWhenPending_A 00100840051773540946
tb.dut.u_edn_core.gen_ep_blk[5].u_prim_packer_fifo_ep.ValidOPairedWithReadyI_A 001008400517735400
tb.dut.u_edn_core.gen_ep_blk[6].u_edn_ack_sm_ep.AckSmErrorStStable_A 001008400516312100
tb.dut.u_edn_core.gen_ep_blk[6].u_edn_ack_sm_ep.FpvSecCmErrorStEscalate_A 001008400516416200
tb.dut.u_edn_core.gen_ep_blk[6].u_edn_ack_sm_ep.u_state_regs.AssertConnected_A 0094694600
tb.dut.u_edn_core.gen_ep_blk[6].u_edn_ack_sm_ep.u_state_regs_A 0010084005990720900
tb.dut.u_edn_core.gen_ep_blk[6].u_prim_packer_fifo_ep.DataOStableWhenPending_A 00100840051712820946
tb.dut.u_edn_core.gen_ep_blk[6].u_prim_packer_fifo_ep.ValidOPairedWithReadyI_A 001008400517128200
tb.dut.u_edn_core.u_edn_main_sm.ErrorStStable_A 001008400516047100
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tb.dut.u_edn_core.u_edn_main_sm.u_state_regs.AssertConnected_A 0094694600
tb.dut.u_edn_core.u_edn_main_sm.u_state_regs_A 0010048103987130700
tb.dut.u_edn_core.u_intr_hw_edn_cmd_req_done.IntrTKind_A 0094694600
tb.dut.u_edn_core.u_intr_hw_edn_fatal_err.IntrTKind_A 0094694600
tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.CheckHotOne_A 0010084005990720900
tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.CheckNGreaterZero_A 0094694600
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tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.IdxKnown_A 0010084005990720900
tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.IndexIsCorrect_A 00100840052468600
tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.LockArbDecision_A 0010084005119977800
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tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.ReqAndReadyImplyGrant_A 00100840052468600
tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.ReqImpliesValid_A 0010084005122547800
tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.ReqStaysHighUntilGranted0_M 0010084005119977800
tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.ValidKnown_A 0010084005990720900
tb.dut.u_edn_core.u_prim_fifo_sync_gencmd.DataKnown_A 00968835754377600
tb.dut.u_edn_core.u_prim_fifo_sync_gencmd.DepthKnown_A 0010084005990720900
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tb.dut.u_edn_core.u_prim_fifo_sync_rescmd.gen_normal_fifo.depthShallNotExceedParamDepth 00987338757854700
tb.dut.u_edn_core.u_prim_mubi4_sync_auto_req_mode.NumCopiesMustBeGreaterZero_A 0094694600
tb.dut.u_edn_core.u_prim_mubi4_sync_auto_req_mode.OutputsKnown_A 0010084005990720900
tb.dut.u_edn_core.u_prim_mubi4_sync_auto_req_mode.gen_no_flops.OutputDelay_A 0010084005990720900
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tb.dut.u_edn_core.u_prim_mubi4_sync_cmd_fifo_rst.NumCopiesMustBeGreaterZero_A 0094694600
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tb.dut.u_edn_core.u_prim_mubi4_sync_edn_enable.NumCopiesMustBeGreaterZero_A 0094694600
tb.dut.u_edn_core.u_prim_mubi4_sync_edn_enable.OutputsKnown_A 0010084005990720900
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tb.dut.u_edn_core.u_prim_packer_fifo_cs.DataOStableWhenPending_A 00100840051312930946
tb.dut.u_edn_core.u_prim_packer_fifo_cs.ValidOPairedWithReadyI_A 001008400513129300
tb.dut.u_reg.en2addrHit 001057869121932700
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tb.dut.u_reg.rePulse 001057869113551400
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tb.dut.u_reg.u_reg_if.u_err.dataWidthOnly32_A 001111111100
tb.dut.u_reg.u_reg_if.u_rsp_intg_gen.DataWidthCheck_A 001111111100
tb.dut.u_reg.u_reg_if.u_rsp_intg_gen.PayLoadWidthCheck 001111111100
tb.dut.u_reg.u_rsp_intg_gen.DataWidthCheck_A 001111111100
tb.dut.u_reg.u_rsp_intg_gen.PayLoadWidthCheck 001111111100
tb.dut.u_reg.wePulse 00105786918381300

Assertions Incomplete:
ASSERTIONSCATEGORYSEVERITYATTEMPTSREAL SUCCESSESFAILURESINCOMPLETESRC
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tb.dut.gen_edn_if_asserts[0].EdnDataStable_A 0010084005746330430
tb.dut.gen_edn_if_asserts[1].EdnDataStableDisable_A 00100840055848710292
tb.dut.gen_edn_if_asserts[1].EdnDataStable_A 001008400549310132
tb.dut.gen_edn_if_asserts[2].EdnDataStableDisable_A 00100840055848710292
tb.dut.gen_edn_if_asserts[2].EdnDataStable_A 001008400526110113
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tb.dut.gen_edn_if_asserts[3].EdnDataStable_A 00100840053262090
tb.dut.gen_edn_if_asserts[4].EdnDataStableDisable_A 00100840055848710292
tb.dut.gen_edn_if_asserts[4].EdnDataStable_A 00100840054340087
tb.dut.gen_edn_if_asserts[5].EdnDataStableDisable_A 00100840055848710292
tb.dut.gen_edn_if_asserts[5].EdnDataStable_A 00100840053401089
tb.dut.gen_edn_if_asserts[6].EdnDataStableDisable_A 00100840055848710292
tb.dut.gen_edn_if_asserts[6].EdnDataStable_A 00100840052902083
tb.dut.u_edn_core.gen_ep_blk[0].u_prim_packer_fifo_ep.DataOStableWhenPending_A 001008400563256540946
tb.dut.u_edn_core.gen_ep_blk[1].u_prim_packer_fifo_ep.DataOStableWhenPending_A 00100840052505070946
tb.dut.u_edn_core.gen_ep_blk[2].u_prim_packer_fifo_ep.DataOStableWhenPending_A 00100840052176640946
tb.dut.u_edn_core.gen_ep_blk[3].u_prim_packer_fifo_ep.DataOStableWhenPending_A 00100840051868010946
tb.dut.u_edn_core.gen_ep_blk[4].u_prim_packer_fifo_ep.DataOStableWhenPending_A 00100840051691850946
tb.dut.u_edn_core.gen_ep_blk[5].u_prim_packer_fifo_ep.DataOStableWhenPending_A 00100840051773540946
tb.dut.u_edn_core.gen_ep_blk[6].u_prim_packer_fifo_ep.DataOStableWhenPending_A 00100840051712820946
tb.dut.u_edn_core.u_prim_arbiter_ppc_packer_arb.RoundRobin_A 001008400500946
tb.dut.u_edn_core.u_prim_packer_fifo_cs.DataOStableWhenPending_A 00100840051312930946


Detail Report for Cover Sequences

Cover Sequences All Matches:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
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tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C 0010579400990
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C 001057940041410
tb.dut.tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C 001057940013130
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Cover Sequences First Matches:
COVER SEQUENCESCATEGORYSEVERITYATTEMPTSALL MATCHESFIRST MATCHESINCOMPLETESRC
tb.dut.tlul_assert_device.gen_device_cov.aValidNotAccepted_C 00105794002782780
tb.dut.tlul_assert_device.gen_device_cov.a_addressChangedNotAccepted_C 001057940064640
tb.dut.tlul_assert_device.gen_device_cov.a_dataChangedNotAccepted_C 001057940065650
tb.dut.tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C 001057940047470
tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C 0010579400990
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C 001057940041410
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tb.dut.tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C 0010579400174617460
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0% 10% 20% 30% 40% 50% 60% 70% 80% 90% 100%