Design Hierarchy
dashboard | hierarchy | modlist | groups | tests | asserts

NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
tb 98.88 99.53 98.47 100.00 96.00 99.76 99.49
dut 98.88 99.53 98.47 100.00 96.00 99.76 99.49
gen_alert_tx[0].u_prim_alert_sender 100.00 100.00
hmac_csr_assert 100.00 100.00
intr_hw_fifo_empty 100.00 100.00 100.00 100.00 100.00
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u_rsp_intg_gen 100.00 100.00 100.00
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reqfifo 100.00 100.00 100.00
rspfifo 100.00 100.00 100.00
gen_dfifo[1].fifo_d 100.00 100.00 100.00 100.00 100.00
reqfifo 100.00 100.00 100.00
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u_rspfifo 97.20 97.14 100.00 91.67 100.00
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u_sramreqfifo 99.26 97.06 100.00 100.00 100.00
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0% 10% 20% 30% 40% 50% 60% 70% 80% 90% 100%