Design Hierarchy
dashboard | hierarchy | modlist | groups | tests | asserts

NAMESCORELINECONDTOGGLEFSMBRANCHASSERT
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dut 93.77 97.12 91.21 97.66 83.58 94.37 98.67
gen_alert_tx[0].u_prim_alert_sender 100.00 100.00
i2c_core 90.49 96.08 86.21 83.58 91.84 94.74
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u_oup_buf 97.16 100.00 88.64 100.00 100.00
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u_sram_ptrs 100.00 100.00 100.00 100.00
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u_reg 98.74 98.54 97.66 100.00 97.50 100.00
subtree...
0% 10% 20% 30% 40% 50% 60% 70% 80% 90% 100%