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Assertions Uncovered:

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Assertions Success:

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Detail Report for Cover Sequences

Cover Sequences All Matches:

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Cover Sequences First Matches:

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tb.dut.tlul_assert_device.gen_device_cov.aValidNotAccepted_C	0	0	826667	598	598	0
tb.dut.tlul_assert_device.gen_device_cov.a_addressChangedNotAccepted_C	0	0	826667	164	164	0
tb.dut.tlul_assert_device.gen_device_cov.a_dataChangedNotAccepted_C	0	0	826667	177	177	0
tb.dut.tlul_assert_device.gen_device_cov.a_maskChangedNotAccepted_C	0	0	826667	115	115	0
tb.dut.tlul_assert_device.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	826667	25	25	0
tb.dut.tlul_assert_device.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	826667	93	93	0
tb.dut.tlul_assert_device.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	826667	83	83	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReqWithSameAddr_C	0	0	826667	2467	2467	0
tb.dut.tlul_assert_device.gen_device_cov.b2bReq_C	0	0	826667	6510	6510	0
tb.dut.tlul_assert_device.gen_device_cov.b2bSameSource_C	0	0	826667	12014	12014	145