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Assertions Uncovered:

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Assertions Incomplete:

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Detail Report for Cover Sequences

Cover Sequences All Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_ram.gen_device_cov.aValidNotAccepted_C	0	0	927154529	836005	836005	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_addressChangedNotAccepted_C	0	0	927154529	300120	300120	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_dataChangedNotAccepted_C	0	0	927154529	275143	275143	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_maskChangedNotAccepted_C	0	0	927154529	122833	122833	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	927154529	185571	185571	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	927154529	81885	81885	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	927154529	159117	159117	1
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReqWithSameAddr_C	0	0	927154529	12356799	12356799	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReq_C	0	0	927154529	25577523	25577523	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bSameSource_C	0	0	927154529	57496618	57496618	643
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C	0	0	927154529	314	314	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C	0	0	927154529	73	73	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C	0	0	927154529	92	92	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C	0	0	927154529	44	44	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	927154529	25	25	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	927154529	56	56	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	927154529	27	27	2
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C	0	0	927154529	1085	1085	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C	0	0	927154529	2600	2600	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C	0	0	927154529	24729823	24729823	765

Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_ram.gen_device_cov.aValidNotAccepted_C	0	0	927154529	836005	836005	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_addressChangedNotAccepted_C	0	0	927154529	300120	300120	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_dataChangedNotAccepted_C	0	0	927154529	275143	275143	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_maskChangedNotAccepted_C	0	0	927154529	122833	122833	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	927154529	185571	185571	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	927154529	81885	81885	1
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	927154529	159117	159117	1
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReqWithSameAddr_C	0	0	927154529	12356799	12356799	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReq_C	0	0	927154529	25577523	25577523	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bSameSource_C	0	0	927154529	57496618	57496618	643
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C	0	0	927154529	314	314	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C	0	0	927154529	73	73	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C	0	0	927154529	92	92	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C	0	0	927154529	44	44	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	927154529	25	25	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	927154529	56	56	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	927154529	27	27	2
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C	0	0	927154529	1085	1085	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C	0	0	927154529	2600	2600	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C	0	0	927154529	24729823	24729823	765