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Assertions Uncovered:

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Assertions Incomplete:

ASSERTIONS	CATEGORY	SEVERITY	ATTEMPTS	REAL SUCCESSES	FAILURES	INCOMPLETE	SRC
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tb.dut.u_prim_lc_sync.gen_flops.OutputDelay_A	0	0	978507586	978387661	0	2553

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Detail Report for Cover Sequences

Cover Sequences All Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_ram.gen_device_cov.aValidNotAccepted_C	0	0	990182124	873675	873675	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_addressChangedNotAccepted_C	0	0	990182124	264888	264888	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_dataChangedNotAccepted_C	0	0	990182124	243779	243779	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_maskChangedNotAccepted_C	0	0	990182124	106310	106310	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	990182124	164154	164154	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	990182124	70688	70688	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	990182124	142495	142495	2
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReqWithSameAddr_C	0	0	990182124	11985420	11985420	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReq_C	0	0	990182124	24441439	24441439	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bSameSource_C	0	0	990182124	62330044	62330044	656
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C	0	0	990182124	365	365	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C	0	0	990182124	79	79	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C	0	0	990182124	100	100	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C	0	0	990182124	47	47	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	990182124	23	23	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	990182124	56	56	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	990182124	38	38	2
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C	0	0	990182124	1078	1078	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C	0	0	990182124	2864	2864	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C	0	0	990182124	23359488	23359488	778

Cover Sequences First Matches:

COVER SEQUENCES	CATEGORY	SEVERITY	ATTEMPTS	ALL MATCHES	FIRST MATCHES	INCOMPLETE	SRC
tb.dut.tlul_assert_device_ram.gen_device_cov.aValidNotAccepted_C	0	0	990182124	873675	873675	0
tb.dut.tlul_assert_device_ram.gen_device_cov.a_addressChangedNotAccepted_C	0	0	990182124	264888	264888	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_dataChangedNotAccepted_C	0	0	990182124	243779	243779	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_maskChangedNotAccepted_C	0	0	990182124	106310	106310	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	990182124	164154	164154	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	990182124	70688	70688	2
tb.dut.tlul_assert_device_ram.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	990182124	142495	142495	2
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReqWithSameAddr_C	0	0	990182124	11985420	11985420	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bReq_C	0	0	990182124	24441439	24441439	0
tb.dut.tlul_assert_device_ram.gen_device_cov.b2bSameSource_C	0	0	990182124	62330044	62330044	656
tb.dut.tlul_assert_device_regs.gen_device_cov.aValidNotAccepted_C	0	0	990182124	365	365	0
tb.dut.tlul_assert_device_regs.gen_device_cov.a_addressChangedNotAccepted_C	0	0	990182124	79	79	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_dataChangedNotAccepted_C	0	0	990182124	100	100	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_maskChangedNotAccepted_C	0	0	990182124	47	47	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_opcodeChangedNotAccepted_C	0	0	990182124	23	23	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sizeChangedNotAccepted_C	0	0	990182124	56	56	2
tb.dut.tlul_assert_device_regs.gen_device_cov.a_sourceChangedNotAccepted_C	0	0	990182124	38	38	2
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReqWithSameAddr_C	0	0	990182124	1078	1078	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bReq_C	0	0	990182124	2864	2864	0
tb.dut.tlul_assert_device_regs.gen_device_cov.b2bSameSource_C	0	0	990182124	23359488	23359488	778