Unified Coverage Report :: Design subhierarchy

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NAME	SCORE	LINE	COND	TOGGLE	BRANCH	ASSERT

top_earlgrey	95.16	95.39	93.73	95.16	94.50	97.02
clk_ctrl_and_main_pd_sva_if	100.00			100.00
u_adc_ctrl_aon	100.00			100.00
u_aes	100.00			100.00
u_alert_handler	99.92			99.92
u_aon_timer_aon	100.00			100.00
u_clkmgr_aon	100.00			100.00
u_csrng	99.72			99.72
u_dft_tap_breakout	100.00	100.00		100.00
u_edn0	99.50			99.50
u_edn1	99.58			99.58
u_entropy_src	99.18			99.18
u_flash_ctrl	99.96			99.96
u_gpio	100.00			100.00
u_hmac	100.00			100.00
u_i2c0	100.00			100.00
u_i2c1	100.00			100.00
u_i2c2	100.00			100.00
u_keymgr	89.72			89.72
u_kmac	99.94			99.94
u_lc_ctrl	89.51			89.51
u_otbn	100.00			100.00
u_otp_ctrl	82.58			82.58
u_pattgen	100.00			100.00
u_pinmux_aon	97.09	96.30	95.25	98.78	95.81	99.30
gen_alert_tx[0].u_prim_alert_sender	100.00			100.00
gen_wkup_detect[0].u_pinmux_wkup	77.78	83.33	77.27		72.73
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[1].u_pinmux_wkup	77.78	83.33	77.27		72.73
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[2].u_pinmux_wkup	79.29	83.33	77.27		77.27
u_prim_filter	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[3].u_pinmux_wkup	75.34	80.56	77.27		68.18
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[4].u_pinmux_wkup	75.34	80.56	77.27		68.18
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[5].u_pinmux_wkup	80.81	83.33	81.82		77.27
u_prim_filter	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[6].u_pinmux_wkup	56.14	63.89	40.91		63.64
u_prim_filter	67.58	76.47	44.44		81.82
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
gen_wkup_detect[7].u_pinmux_wkup	76.26	83.33	72.73		72.73
u_prim_filter	93.27	100.00	88.89		90.91
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pinmux_strap_sampling	98.82	99.62	95.65		100.00	100.00
subtree...
u_reg	98.47	96.30	97.66		99.92	100.00
subtree...
u_usbdev_aon_wake	98.32	100.00	95.16		98.11	100.00
filter_activity	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
filter_bus_reset	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
filter_sense	100.00	100.00	100.00		100.00
gen_async.prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pullup_en_cdc	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_pwm_aon	100.00			100.00
u_pwrmgr_aon	100.00			100.00
u_rom_ctrl	99.96			99.96
u_rstmgr_aon	100.00			100.00
u_rv_core_ibex	96.37	97.52	95.36	98.69	98.13	92.14
subtree...
u_rv_dm	100.00			100.00
u_rv_plic	94.84	93.88	91.15	100.00	92.76	96.43
gen_alert_tx[0].u_prim_alert_sender	100.00			100.00
gen_target[0].u_target	91.47	88.57	77.33		100.00	100.00
u_prim_max_tree	91.45	88.49	77.30		100.00	100.00
u_gateway	75.00	100.00	25.00		100.00
u_prim_flop_2sync	100.00	100.00			100.00
u_sync_1	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_sync_2	100.00	100.00			100.00
gen_generic.u_impl_generic	100.00	100.00			100.00
u_reg	96.12	94.38	99.94		90.16	100.00
subtree...
u_rv_timer	100.00			100.00
u_sensor_ctrl_aon	93.48	91.43	88.95	93.39	93.65	100.00
subtree...
u_spi_device	98.42			98.42
u_spi_host0	96.59			96.59
u_spi_host1	96.30			96.30
u_sram_ctrl_main	100.00			100.00
u_sram_ctrl_ret_aon	100.00			100.00
u_sysrst_ctrl_aon	100.00			100.00
u_uart0	100.00			100.00
u_uart1	100.00			100.00
u_uart2	100.00			100.00
u_uart3	100.00			100.00
u_usbdev	95.02			95.02
u_xbar_main	100.00			100.00
u_xbar_peri	100.00			100.00
u_ast	94.57			94.57
u_padring	99.20	99.77	100.00	96.22	100.00	100.00
gen_dio_pads[10].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[11].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[12].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[13].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[14].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[15].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[16].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[17].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[18].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[19].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[1].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[20].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[21].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[22].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[2].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_dio_pads[5].u_dio_pad	100.00	100.00				100.00
gen_generic.u_impl_generic	100.00	100.00				100.00
gen_dio_pads[8].u_dio_pad	100.00	100.00				100.00
gen_generic.u_impl_generic	100.00	100.00				100.00
gen_dio_pads[9].u_dio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[0].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[10].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[11].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[12].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[13].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[14].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[15].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[16].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[17].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[18].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[19].u_mio_pad	100.00	100.00	100.00		100.00	100.00
gen_generic.u_impl_generic	100.00	100.00	100.00		100.00	100.00
gen_mio_pads[1].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[20].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[21].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[22].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[23].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[24].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[25].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[26].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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gen_mio_pads[27].u_mio_pad	100.00	100.00	100.00		100.00	100.00
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